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參數(shù)資料
| 型號： | SiI3114 |
| 廠商： | Silicon Image, Inc. |
| 英文描述： | PCI to Serial ATA Controller |
| 中文描述： | PCI到Serial ATA控制器 |
| 文件頁數(shù)： | 54/127頁 |
| 文件大?。?/td> | 598K |
| 代理商： | SII3114 |
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SiI
3114 PCI to Serial ATA Controller
Data Sheet
Silicon Image, Inc.
Internal Register Space – Base Address 5
SiI
-DS-0103-D
46
2007 Silicon Image, Inc.
These registers are 32-bits wide and define the internal operation of the
SiI
3114. The access types are defined as
follows: R=read, W=write, and C=clearable by some write operation. Access to this register is through the PCI
Memory space. Base Address 5 accesses can be disabled by setting input BA5_EN low. Table 22 shows the
internal register space for base 5 addresses.
Table 22.
SiI
3114 Internal Register Space – Base Address 5
Register Name
Address
Offset
31 16
15 00
Access
Type
00
H
Reserved
PCI Bus Master
Status – Channel
0
PRD Table Address – Channel 0
PCI Bus Master
Status – Channel
1
PRD Table Address – Channel 1
PCI Bus Master
Status2 – Channel
0
Reserved
PCI Bus Master
Status2 – Channel
1
Reserved
PRD Address – Channel 0
PCI Bus Master Byte Count – Channel 0
PRD Address – Channel 1
PCI Bus Master Byte Count – Channel 1
Reserved
Reserved
Reserved
Reserved
Software Data
PCI Bus Master
Command –
Channel 0
R/W
04
H
R/W
R/W
08
H
Reserved
Reserved
PCI Bus Master
Command –
Channel 1
0C
H
R/W
R/W
10
H
PCI Bus Master
Status – Channel
1
Software Data
PCI Bus Master
Command2 –
Channel 0
14
H
-
18
H
Reserved
Reserved
PCI Bus Master
Command2 –
Channel 1
R/W
1C
H
20
H
24
H
28
H
2C
H
30
H
34
H
38
H
3C
H
-
R
R
R
R
-
-
-
-
40
H
FIFO Valid Byte Count – Channel 0
FIFO Wr Request
Control – Channel
0
FIFO Wr Request
Control – Channel
1
FIFO Rd Request
Control – Channel
0
FIFO Rd Request
Control – Channel
1
R/W
44
H
FIFO Valid Byte Count – Channel 1
R/W
48
H
4C
H
50
H
System Configuration Status
System Command
R/W
R/W
R/W
R/W
System Software Data
Flash Memory Address – Command and Status
54
H
Reserved
GPIO Control
Flash Memory
Data
58
H
EEPROM Memory Address – Command and Status
R/W
R/W
5C
H
Reserved
EEPROM Memory
Data
60
H
64
H
FIFO Port – Channel 0
Reserved
FIFO Byte1 Read
Pointer – Channel
0
R/W
-
R
68
H
FIFO Byte1 Write
Pointer – Channel
0
FIFO Byte0 Write
Pointer – Channel
0
FIFO Byte0 Read
Pointer – Channel
0
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PDF描述 |
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