參數(shù)資料
型號(hào)： SC16C752IB48,157
廠商： NXP Semiconductors
文件頁(yè)數(shù)： 22/47頁(yè)
文件大小： 0K
描述： IC DUAL UART 64BYTE 48LQFP
標(biāo)準(zhǔn)包裝： 1,250
通道數(shù)： 2，DUART
FIFO's： 64 字節(jié)
電源電壓： 2.5V，3.3V，5V
帶自動(dòng)流量控制功能： 是
帶故障啟動(dòng)位檢測(cè)功能： 是
帶調(diào)制解調(diào)器控制功能： 是
安裝類型： 表面貼裝
封裝/外殼： 48-LQFP
供應(yīng)商設(shè)備封裝： 48-LQFP（7x7）
包裝： 托盤(pán)
其它名稱： 935270055157
SC16C752IB48
SC16C752IB48-ND
Philips Semiconductors
SC16C752
Dual UART with 64-byte FIFO
Product data
Rev. 04 — 20 June 2003
29 of 47
9397 750 11635
Koninklijke Philips Electronics N.V. 2003. All rights reserved.
7.14 FIFO ready register
The FIFO ready register provides real-time status of the transmit and receive FIFOs
of both channels.
The FIFO Rdy register is a read-only register that can be accessed when any of the
two UARTs is selected CSA or CSB = 0, MCR[2] (FIFO Rdy Enable) is a logic 1, and
loop-back is disabled. The address is 111.
Table 22:
FIFO Ready Register bits description
Bit
Symbol
Description
7-6
FIFO Rdy[7:6]
Unused; always 0.
5
FIFO Rdy[5]
RX FIFO B status. Related to DMA.
4
FIFO Rdy[4]
RX FIFO A status. Related to DMA.
3-2
FIFO Rdy[3:2]
Unused; always 0.
1
FIFO Rdy[1]
TX FIFO B status. Related to DMA.
0
FIFO Rdy[0]
TX FIFO A status. Related to DMA.
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