參數(shù)資料
型號(hào): S5935QF
廠商: APPLIEDMICRO INC
元件分類: 總線控制器
英文描述: PCI 5V Bus Master/Target Device 32-bit
中文描述: PCI BUS CONTROLLER, PQFP160
封裝: PLASTIC, QFP-160
文件頁數(shù): 115/190頁
文件大?。?/td> 748K
代理商: S5935QF
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8-107
ADD-ON BUS INTERFACE
S5935
Timing
Spec.
8T(max)
7T–10(max)
T(max)
6T–10(max)
6T(max)
T = 30 ns
240 ns
200 ns
30 ns
170 ns
180 ns
2 ns
Read cycle time
Address valid to data valid
Address valid to read active
Read active to data valid
Read pulse width
Data hold from read inactive
Memory Device Requirements for Read Accesses
Figure 5. nv Memory Read Operation
Data Valid
EQ[7:0]
(INPUT)
EA[15:0]
(OUTPUT)
ERD#
(OUTPUT)
Address Valid
t
35
t
36
t
37
t
39
t
38
t
41
t
40
nv Memory Device Timing Requirements
For serial nv memory devices, the serial clock output
frequency is the PCI clock frequency divided by 512.
This is approximately 65 KHz (with a 33 MHz PCI
clock). Any serial memory device that operates at this
frequency is compatible with the S5935.
For byte-wide accesses, the S5935 generates the
waveforms shown in Figures 5 and 6. Figure 5 shows
an nv memory read operation. Figure 6 shows an nv
memory write operation. Read operations are always
the same length. Write operations, due to the charac-
teristics of reprogrammable nv memory devices, may
be controlled through a programming sequence.
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