參數(shù)資料
型號： PIC16F785
廠商： Microchip Technology Inc.
英文描述： 20-Pin Flash-Based 8-Bit CMOS Microcontroller with Two-Phase Asychronous Feedback PWM, Dual High-Speed Comparators and Dual Operational Amplifiers
中文描述： 20引腳基于閃存的8兩相異步反饋的PWM，雙高位CMOS微控制器的高速比較器和雙運(yùn)算放大器
文件頁數(shù)： 80/178頁
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代理商： PIC16F785
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PIC16F785
DS41249A-page 78
Preliminary
2004 Microchip Technology Inc.
12.1
A/D Configuration and Operation
There are four registers available to control the
functionality of the A/D module:
1.
2.
3.
4.
ANSEL0 (Register 12-1)
ANSEL1 (Register 12-2)
ADCON0 (Register 12-3)
ADCON1 (Register 12-4)
12.1.1
ANALOG PORT PINS
The
ANSEL0<7:0>) and the TRISA<4,2:0>, TRISB<5:4>
and TRISC<7:6,3:0>> bits control the operation of the
A/D port pins. Set the corresponding TRISx bits to ‘
1
’ to
set the pin output driver to its high-impedance state.
Likewise, set the corresponding ANSx bit to disable the
digital input buffer.
ANS<11:0>
bits
(ANSEL1<3:0>
and
12.1.2
CHANNEL SELECTION
There are fourteen analog channels on the PIC16F785.
The CHS<3:0> bits (ADCON0<5:2>) control which
channel is connected to the sample and hold circuit.
12.1.3
VOLTAGE REFERENCE
There are two options for the voltage reference to the
A/D converter: either V
DD
is used or an analog voltage
applied to V
REF
is used. The VCFG bit (ADCON0<6>)
controls the voltage reference selection. If VCFG is set,
then the voltage on the V
REF
pin is the reference;
otherwise, V
DD
is the reference.
12.1.4
CONVERSION CLOCK
The A/D conversion cycle requires 11 T
AD
. The source
of the conversion clock is software selectable via the
ADCS bits (ADCON1<6:4>). There are seven possible
clock options:
F
OSC
/2
F
OSC
/4
F
OSC
/8
F
OSC
/16
F
OSC
/32
F
OSC
/64
F
RC
(dedicated internal oscillator)
For correct conversion, the A/D conversion clock
(1/T
AD
) must be selected to ensure a minimum T
AD
of
1.6 μs. Table 12-1 shows a few T
AD
calculations for
selected frequencies.
TABLE 12-1:
T
AD
VS. DEVICE OPERATING FREQUENCIES
Note:
Analog voltages on any pin that is defined
as a digital input may cause the input
buffer to conduct excess current.
A/D Clock Source (T
AD
)
Operation
2 T
OSC
4 T
OSC
8 T
OSC
16 T
OSC
32 T
OSC
64 T
OSC
A/D RC
Legend:
Shaded cells are outside of recommended range.
Note 1:
The A/D RC source has a typical T
AD
time of 4 μs for V
DD
> 3.0V.
2:
These values violate the minimum required T
AD
time.
3:
For faster conversion times, the selection of another clock source is recommended.
4:
When the device frequency is greater than 1 MHz, the A/D RC clock source is only recommended if the
conversion will be performed during Sleep.
Device Frequency
5 MHz
400 ns
(2)
800 ns
(2)
1.6 μs
3.2 μs
6.4 μs
12.8 μs
(3)
2–6 μs
(1,4)
ADCS2:ADCS0
000
100
001
101
010
110
x11
20 MHz
100 ns
(2)
200 ns
(2)
400 ns
(2)
800 ns
(2)
1.6 μs
3.2 μs
2–6 μs
(1,4)
4 MHz
500 ns
(2)
1.0 μs
(2)
2.0 μs
4.0 μs
8.0 μs
(3)
16.0 μs
(3)
2–6 μs
(1,4)
1.25 MHz
1.6 μs
3.2 μs
6.4 μs
12.8 μs
(3)
25.6 μs
(3)
51.2 μs
(3)
2–6 μs
(1,4)
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