參數(shù)資料
型號(hào)： PIC16F785
廠商： Microchip Technology Inc.
英文描述： 20-Pin Flash-Based 8-Bit CMOS Microcontroller with Two-Phase Asychronous Feedback PWM, Dual High-Speed Comparators and Dual Operational Amplifiers
中文描述： 20引腳基于閃存的8兩相異步反饋的PWM，雙高位CMOS微控制器的高速比較器和雙運(yùn)算放大器
文件頁數(shù)： 66/178頁
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代理商： PIC16F785
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PIC16F785
DS41249A-page 64
Preliminary
2004 Microchip Technology Inc.
9.1.2
COMPARATOR C2 CONTROL
REGISTERS
The CM2CON0 register is a functional copy of the
CM1CON0 register described in Section 9.1.1. A sec-
ond control register, CM2CON1, is also present for
control of an additional synchronizing feature, as well
as mirrors of both comparator outputs.
9.1.2.1
Control Register CM2CON0
The CM2CON0 register, shown in Register 9-2, con-
tains the control and Status bits for Comparator C2.
Setting C2ON (CM2CON0<7>) enables Comparator
C2 for operation.
Bits C2CH<1:0> (CM2CON0<1:0>) select the compar-
ator input from the four analog pins, AN<7:5,1>.
C2R (CM2CON0<2>) selects the reference to be used
with the comparator. Setting C2R (CM2CON0<2>)
selects the C2V
REF
output of the comparator voltage
reference module as the reference voltage for the com-
parator. Clearing C2R selects the C2IN+ input on the
RC0/AN4/C2IN+ pin.
The output of the comparator is available internally via
the C2OUT bit (CM2CON0<6>). To make the output
available for an external connection, the C2OE bit
(CM2CON0<5>) must be set.
The comparator output, C2OUT, can be inverted by
setting the C2POL bit (CM2CON0<4>). Clearing
C2POL results in a non-inverted output.
A complete table showing the output state versus input
conditions and the polarity bit is shown in Table 9-2.
C2SP (CM2CON0<3>) configures the speed of the
comparator. When C2SP is set, the comparator oper-
ates at its normal speed. Clearing C2SP operates the
comparator in low-power mode.
FIGURE 9-2:
COMPARATOR C2 SIMPLIFIED BLOCK DIAGRAM
Note 1:
To use AN<7:5,1> as analog inputs, the
appropriate bits must be programmed to
1
in the ANSEL0 register.
TABLE 9-2:
C2 OUTPUT STATE VERSUS
INPUT CONDITIONS
Input Condition
C2POL
C2OUT
C2VN > C2VP
C2VN < C2VP
C2VN > C2VP
C2VN < C2VP
0
0
1
1
0
1
1
0
Note 1:
The internal output of the comparator is
latched at the end of each instruction
cycle. External outputs are not latched.
2:
The C2 interrupt will operate correctly
with C2OE set or cleared. An external
output is not required for the C2 interrupt.
3:
For C2 output on RC4/C2OUT/PH2:
(C2OE=1) & (C2ON=1) & (TRISA<4>=0).
MUX
2
C2
C2POL
C2OUT
To PWM Logic
0
1
3
C2ON
(1)
C2SP
C2CH<1:0>
2
0
1
C2R
From TMR1
Clock
Note
1:
When C2ON = 0, the C2 comparator will produce a ‘
0
’ output to the XOR Gate.
2:
Timer1 gate control (see Figure 6-2 on page 50).
C20E
C2V
REF
MUX
D
Q
EN
D
Q
EN
CL
D
Q
RD_CM2CON0
Q3*RD_CM2CON0
Q1
Set C2IF
To
NRESET
C2VN
C2VP
RC4/C2OUT/PH2
RC0/AN4/C2IN+
RA1/AN1/C12IN0-/V
REF
/ICSPCLK
RC1/AN5/C12IN1-/PH1
RC2/AN6/C12IN2-/OP2
RC3/AN7/C12IN3-/OP1
0
1
C2SYNC
SYNCC2OUT
(2)
C2POL
Data Bus
MUX
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