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參數(shù)資料
| 型號： | PIC16F785 |
| 廠商： | Microchip Technology Inc. |
| 英文描述： | 20-Pin Flash-Based 8-Bit CMOS Microcontroller with Two-Phase Asychronous Feedback PWM, Dual High-Speed Comparators and Dual Operational Amplifiers |
| 中文描述： | 20引腳基于閃存的8兩相異步反饋的PWM，雙高位CMOS微控制器的高速比較器和雙運算放大器 |
| 文件頁數(shù)： | 49/178頁 |
| 文件大?。?/td> | 1620K |
| 代理商： | PIC16F785 |
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2004 Microchip Technology Inc.
Preliminary
DS41249A-page 47
PIC16F785
5.0
TIMER0 MODULE
The Timer0 module timer/counter has the following
features:
8-bit timer/counter
Readable and writable
8-bit software programmable prescaler
Internal or external clock select
Interrupt on overflow from FFh to 00h
Edge select for external clock
Figure 5-1 is a block diagram of the Timer0 module and
the prescaler shared with the WDT.
5.1
Timer0 Operation
Timer mode is selected by clearing the T0CS bit
(OPTION_REG<5>). In Timer mode, the Timer0
module will increment every instruction cycle (without
prescaler). If TMR0 is written, the increment is inhibited
for the following two instruction cycles. The user can
work around this by writing an adjusted value to the
TMR0 register.
Counter mode is selected by setting the T0CS bit
(OPTION_REG<5>). In this mode, the Timer0 module
will increment either on every rising or falling edge of
pin RA2/AN2/T0CKI/INT/C1OUT. The incrementing
edge is determined by the source edge (T0SE) control
bit (OPTION_REG<4>). Clearing the T0SE bit selects
the rising edge.
5.2
Timer0 Interrupt
A Timer0 interrupt is generated when the TMR0
register timer/counter overflows from FFh to 00h. This
overflow sets the T0IF bit (INTCON<2>). The interrupt
can be masked by clearing the T0IE bit (INTCON<5>).
The T0IF bit must be cleared in software by the Timer0
module Interrupt Service Routine before re-enabling
this interrupt. The Timer0 interrupt cannot wake the
processor from Sleep since the timer is shut-off during
Sleep.
FIGURE 5-1:
BLOCK DIAGRAM OF THE TIMER0/WDT PRESCALER
Note:
Additional information on the Timer0
module is available in the PICmicro
Mid-Range
Reference
(DS33023).
Manual,
Note 1:
Counter mode has specific external clock
requirements. Additional information on
these requirements is available in the
PICmicro
Mid-Range
Manual, (DS33023).
2:
The ANSEL0 (91h) register must be
initialized to configure an analog channel
as a digital input. Pins configured as
analog inputs will read ‘
0
’.
Reference
T0SE
(1)
CLKOUT
(= F
OSC
/4)
TMR0
Watchdog
Timer
WDT
Time-out
PS<0:2>
(1)
WDTE
SWDTEN
Data Bus
Set Flag bit T0IF
on Overflow
T0CS
(1)
Note
1:
2:
T0SE, T0CS, PSA, PS<2:0> are bits in the OPTION_REG (see Register 2-2 on page 16).
WDTPS<3:0> are bits in the WDTCON register (see Register 15-2 on page 118).
0
1
0
1
0
1
SYNC 2
Cycles
8
8
8-bit
Prescaler
0
1
PSA
(1)
PSA
(1)
PSA
(1)
16-bit
Prescaler
16
WDTPS<3:0>
(2)
31 kHz
INTRC
RA2/AN2/T0CKI/INT/C1OUT
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