參數(shù)資料
型號： PIC16F785
廠商： Microchip Technology Inc.
英文描述： 20-Pin Flash-Based 8-Bit CMOS Microcontroller with Two-Phase Asychronous Feedback PWM, Dual High-Speed Comparators and Dual Operational Amplifiers
中文描述： 20引腳基于閃存的8兩相異步反饋的PWM，雙高位CMOS微控制器的高速比較器和雙運算放大器
文件頁數(shù)： 13/178頁
文件大?。?/td> 1620K
代理商： PIC16F785
2004 Microchip Technology Inc.
Preliminary
DS41249A-page 11
PIC16F785
TABLE 2-2:
PIC16F785 SPECIAL FUNCTION REGISTERS SUMMARY BANK 0
Addr
Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Value on:
POR, BOR
Page
Bank 0
00h
01h
02h
03h
04h
05h
06h
07h
08h
09h
0Ah
0Bh
0Ch
0Dh
0Eh
0Fh
INDF
TMR0
PCL
STATUS
FSR
PORTA
(1)
PORTB
(1)
PORTC
(1)
—
—
PCLATH
INTCON
PIR1
—
TMR1L
TMR1H
Addressing this location uses contents of FSR to address data memory (not a physical register)
Timer0 Module’s register
Program Counter's (PC) Least Significant Byte
IRP
RP1
RP0
TO
Indirect data memory address pointer
—
—
RA5
RA4
RB7
RB6
RB5
RB4
RC7
RC6
RC5
RC4
Unimplemented
Unimplemented
—
—
—
Write buffer for upper 5 bits of program counter
GIE
PEIE
T0IE
INTE
EEIF
ADIF
CCP1IF
C2IF
Unimplemented
Holding register for the Least Significant Byte of the 16-bit TMR1
Holding register for the Most Significant Byte of the 16-bit TMR1
xxxx xxxx
22,110
47,110
21,110
15,110
22,110
33,110
40,110
43,110
—
—
21,110
17,110
19,110
—
49,110
49,110
51,110
xxxx xxxx
0000 0000
PD
Z
DC
C
0001 1xxx
xxxx xxxx
RA3
—
RC3
RA2
—
RC2
RA1
—
RC1
RA0
—
RC0
--x0 x000
xx00 ----
00xx 0000
—
—
---0 0000
RAIE
C1IF
T0IF
OSFIF
INTF
TMR2IF
RAIF
TMR1IF
0000 0000
0000 0000
—
xxxx xxxx
xxxx xxxx
10h
11h
12h
13h
T1CON
TMR2
T2CON
T1GINV
Timer2 Module register
—
TMR1GE
T1CKPS1
T1CKPS0
T1OSCEN
T1SYNC
TMR1CS
TMR1ON
0000 0000
0000 0000
53,110
53,110
55,110
TOUTPS3
TOUTPS2
TOUTPS1
TOUTPS0
TMR2ON
T2CKPS1
T2CKPS0
-000 0000
CCPR1L
Capture/Compare/PWM Register1 Low Byte
xxxx xxxx
14h
CCPR1H
Capture/Compare/PWM Register1 High Byte
—
—
xxxx xxxx
55,110
15h
CCP1CON
—
—
WDTCON
DC1B1
DC1B0
CCP1M3
CCP1M2
CCP1M1
CCP1M0
--00 0000
—
—
55,110
16h
17h
18h
Unimplemented
Unimplemented
—
—
—
—
—
WDTPS3
WDTPS2
WDTPS1
WDTPS0
SWDTEN
---0 1000
—
—
—
—
—
118,110
19h
1Ah
1Bh
1Ch
1Dh
1Eh
—
—
—
—
—
Unimplemented
Unimplemented
Unimplemented
Unimplemented
Unimplemented
Most Significant 8 bits of the left justified A/D result or 2 bits of right justified result
—
—
—
—
—
ADRESH
xxxx xxxx
79,110
81,110
1Fh
Legend:
Note
ADCON0
— = Unimplemented locations read as ‘
0
’, u = unchanged, x = unknown, q = value depends on condition. shaded = unimplemented
1:
Port pins with analog functions controlled by the ANSEL0 and ANSEL1 registers will read ‘
0
’ immediately after a reset even though the
data latches are either undefined (POR) or unchanged (other resets).
ADFM
VCFG
CHS3
CHS2
CHS1
CHS0
GO/DONE
ADON
0000 0000
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PDF描述
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