參數(shù)資料
型號(hào)： PIC16F785
廠商： Microchip Technology Inc.
英文描述： 20-Pin Flash-Based 8-Bit CMOS Microcontroller with Two-Phase Asychronous Feedback PWM, Dual High-Speed Comparators and Dual Operational Amplifiers
中文描述： 20引腳基于閃存的8兩相異步反饋的PWM，雙高位CMOS微控制器的高速比較器和雙運(yùn)算放大器
文件頁數(shù)： 113/178頁
文件大?。?/td> 1620K
代理商： PIC16F785
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2004 Microchip Technology Inc.
Preliminary
DS41249A-page 111
PIC16F785
ANSEL1
93h
---- 1111
---- 1111
---- uuuu
WPUA
95h
--11 1111
--11 1111
--uu uuuu
IOCA
96h
--00 0000
--00 0000
--uu uuuu
REFCON
98h
--00 000-
--00 000-
--uu uuu-
VRCON
99h
000- 0000
000- 0000
uuu- uuuu
EEDAT
9Ah
0000 0000
0000 0000
uuuu uuuu
EEADR
9Bh
0000 0000
0000 0000
uuuu uuuu
EECON1
9Ch
---- x000
---- q000
---- uuuu
EECON2
9Dh
---- ----
---- ----
---- ----
ADRESL
9Eh
xxxx xxxx
uuuu uuuu
uuuu uuuu
ADCON1
9Fh
-000 ----
-000 ----
-uuu ----
PWMCON1
110h
0000 0000
0000 0000
uuuu uuuu
PWMCON0
111h
0000 0000
0000 0000
uuuu uuuu
PWMCLK
112h
0000 0000
0000 0000
uuuu uuuu
PWMPH1
113h
0000 0000
0000 0000
uuuu uuuu
PWMPH2
114h
0000 0000
0000 0000
uuuu uuuu
CM1CON0
119h
0000 0000
0000 0000
uuuu uuuu
CM2CON0
11Ah
0000 0000
0000 0000
uuuu uuuu
CM2CON1
11Bh
00-- --10
00-- --10
uu-- --uu
OPA1CON
11Ch
0--- ----
0--- ----
u--- ----
OPA2CON
Legend:
Note 1:
11Dh
0--- ----
0--- ----
u--- ----
TABLE 15-4:
INITIALIZATION CONDITION FOR REGISTERS (CONTINUED)
MCLR Reset
WDT Reset (Continued)
Brown-out Reset
(1)
Register
Address
Power-on
Reset
Wake-up from Sleep
through interrupt
Wake-up from Sleep
through WDT time out
u
= unchanged,
x
= unknown, — = unimplemented bit, reads as ‘
0
’,
q
= value depends on condition.
If V
DD
goes too low, Power-on Reset will be activated and registers will be affected differently.
One or more bits in INTCON and/or PIR1 will be affected (to cause wake-up).
When the wake-up is due to an interrupt and the GIE bit is set, the PC is loaded with the interrupt
vector (0004h).
See Table 15-5 for Reset value for specific condition.
If Reset was due to brown-out, then bit 0 =
0
. All other Resets will cause bit 0 =
u
.
Analog channels read
0
but data latches are unknown.
Analog channels read
0
but data latches are unchanged.
2:
3:
4:
5:
6:
7:
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