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參數(shù)資料
| 型號： | PIC16F785 |
| 廠商： | Microchip Technology Inc. |
| 英文描述： | 20-Pin Flash-Based 8-Bit CMOS Microcontroller with Two-Phase Asychronous Feedback PWM, Dual High-Speed Comparators and Dual Operational Amplifiers |
| 中文描述： | 20引腳基于閃存的8兩相異步反饋的PWM，雙高位CMOS微控制器的高速比較器和雙運算放大器 |
| 文件頁數(shù)： | 116/178頁 |
| 文件大小： | 1620K |
| 代理商： | PIC16F785 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁當(dāng)前第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁
PIC16F785
DS41249A-page 114
Preliminary
2004 Microchip Technology Inc.
15.4.1
RA2/AN2/T0CKI/INT/C1OUT
INTERRUPT
External interrupt on RA2/AN2/T0CKI/INT/C1OUT pin
is edge-triggered; either rising, if INTEDG bit
(OPTION<6>) is set, or falling, if INTEDG bit is clear.
When a valid edge appears on the RA2/AN2/T0CKI/
INT/C1OUT pin, the INTF bit (INTCON<1>) is set. This
interrupt can be disabled by clearing the INTE control
bit (INTCON<4>). The INTF bit must be cleared in soft-
ware in the Interrupt Service Routine before re-
enabling this interrupt. The RA2/AN2/T0CKI/INT/
C1OUT interrupt can wake-up the processor from
Sleep if the INTE bit was set prior to going into Sleep.
The status of the GIE bit decides whether or not the
processor branches to the interrupt vector following
wake-up (0004h). See
Section 15.7 “Power-Down
Mode (Sleep)”
for details on Sleep and Figure 15-10
for timing of wake-up from Sleep through RA2/AN2/
T0CKI/INT/C1OUT interrupt.
15.4.2
An overflow (FFh
→
00h) in the TMR0 register will set
the T0IF (INTCON<2>) bit. The interrupt can be
enabled/disabled
by
(INTCON<5>) bit. See
Section 5.0 “Timer0 Module”
for operation of the Timer0 module.
TMR0 INTERRUPT
setting/clearing
T0IE
15.4.3
PORTA INTERRUPT
An input change on PORTA change sets the RAIF
(INTCON<0>) bit. The interrupt can be enabled/
disabled by setting/clearing the RAIE (INTCON<3>)
bit. Plus, individual pins can be configured through the
IOCA register.
FIGURE 15-7:
INTERRUPT LOGIC
IOC-RA0
IOCA0
Note:
The ANSEL0 (91h), and ANSEL1 (93h)
registers must be initialized to configure
an analog channel as a digital input. Pins
configured as analog inputs will read ‘
0
’.
Note:
If a change on the I/O pin should occur
when the read operation is being executed
(start of the Q2 cycle), then the RAIF
interrupt flag may not get set.
TMR1IF
TMR1IE
C1IF
C1IE
T0IF
T0IE
INTF
INTE
RAIF
RAIE
GIE
PEIE
Wake-up (If in Sleep mode)
Interrupt to CPU
EEIE
OSFIF
OSFIE
EEIF
ADIF
ADIE
IOC-RA1
IOCA1
IOC-RA2
IOCA2
IOC-RA3
IOCA3
IOC-RA4
IOCA4
IOC-RA5
IOCA5
TMR2IF
TMR2IE
CCP1IF
CCP1IE
C2IF
C2IE
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