參數(shù)資料
型號(hào)： PIC16F785
廠商： Microchip Technology Inc.
英文描述： 20-Pin Flash-Based 8-Bit CMOS Microcontroller with Two-Phase Asychronous Feedback PWM, Dual High-Speed Comparators and Dual Operational Amplifiers
中文描述： 20引腳基于閃存的8兩相異步反饋的PWM，雙高位CMOS微控制器的高速比較器和雙運(yùn)算放大器
文件頁(yè)數(shù)： 74/178頁(yè)
文件大?。?/td> 1620K
代理商： PIC16F785
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PIC16F785
DS41249A-page 72
Preliminary
2004 Microchip Technology Inc.
10.2.1 VR STABILIZATION PERIOD
When the voltage reference module is enabled, it will
require some time for the reference and its amplifier
circuits to stabilize. The user program must include a
small delay routine to allow the module to settle. See
the electrical specifications section for the minimum
delay requirement.
The internal circuitry automatically recognizes when
the voltage reference is required by the combination
and purpose of various SFR control bits. The VREN
enable bit allows the user to keep the voltage refer-
ence enabled even when SFR control bits would
otherwise disable the reference. This precludes the
need to wait for the voltage reference to stabilize when
modules are switched in and out of service.
FIGURE 10-2:
VR REFERENCE BLOCK DIAGRAM
TABLE 10-1:
REGISTERS ASSOCIATED WITH THE COMPARATOR AND VOLTAGE REFERENCE
MODULES
RA1/AN1/C12IN0-/V
REF
VREN
Voltage
Reference
EN
RDY
To CV
REF
mux
BGST
VR
1
0
1X
Analog
Buffer
CV
REF
VRBB
VR
OUT
CVROE
(CVROE + (VREN*VROE))
1
0
Address
Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Value on:
POR, BOR
Value on
all other
RESETS
119h
11Ah
11Bh
85h,
185h
87h,
187h
05h,
105h
07h,
107h
91h
0Ch
8Ch
98h
99h
Legend:
x
= unknown,
u
= unchanged,
-
= unimplemented, read as ‘
0
’. Shaded cells are not used for comparator.
CM1CON0
CM2CON0
CM2CON1 MC1OUT MC2OUT
TRISA
—
C1ON
C2ON
C1OUT
C2OUT
C1OE
C2OE
—
C1POL
C2POL
—
C1SP
C2SP
—
C1R
C2R
—
C1CH1
C2CH1
TIGSS
C1CH0
C2CH0
C2SYNC
0000 0000
0000 0000
0000 0000
0000 0000
00-- --10
00-- --10
—
TRISA5
TRISA4
TRISA3 TRISA2
TRISA1
TRISA0
--11 1111
--11 1111
TRISC
TRISC7
TRISC6
TRISC5
TRISC4 TRISC3 TRISC2
TRISC1
TRISC0
1111 1111
1111 1111
PORTA
—
—
RA5
RA4
RA3
RA2
RA1
RA0
--xx xxxx
--uu uuuu
PORTC
RC7
RC6
RC5
RC4
RC3
RC2
RC1
RC0
xxxx xxxx
uuuu uuuu
ANSEL0
PIR1
PIE1
REFCON
VRCON
ANS7
EEIF
EEIE
—
C1VREN C2VREN
ANS6
ADIF
ADIE
—
ANS5
CCP1IF
CCP1IE
BGST
VRR
ANS4
C2IF
C2IE
VRBB
—
ANS3
C1IF
C1IE
VREN
VR3
ANS2
OSFIF TMR2IF
OSFIE TMR2IE
VROE CVROE
VR2
ANS1
ANS0
TMR1IF
TMR1IE
—
VR0
1111 1111
1111 1111
0000 ---0
0000 ---0
0000 ---0
0000 ---0
--00 000-
--00 000-
VR1
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