參數資料
型號： MT90883
廠商： Zarlink Semiconductor Inc.
英文描述： TDM to Packet Processors
中文描述： TDM到分組處理器
文件頁數： 89/97頁
文件大?。?/td> 702K
代理商： MT90883
MT90880/1/2/3
Data Sheet
89
Zarlink Semiconductor Inc.
Figure 47 - MII Port Transmit Characteristics
10.3.2 MII Receive
Table 35 - Packet Interface Timing - MII Receive
Figure 48 - MII Port Receive Characteristics
Parameter
Symbol
10 Mbs
100 Mbs
Units
Min.
Typ.
Max.
Min.
Typ.
Max.
Data input setup time
t
DS
10
-
-
10
-
-
ns
Data input hold time
t
DH
5
-
-
5
-
-
ns
Data valid input setup time
t
DVS
10
-
-
10
-
-
ns
Data valid input hold time
t
DVH
5
-
-
5
-
-
ns
RXCLK high wide time
t
CH
140
200
260
14
20
26
ns
RXCLK low wide time
t
CL
140
200
260
14
20
26
ns
RXCLK rise time
t
CR
-
-
5
-
-
5
ns
RXCLK fall time
t
CF
-
-
5
-
-
5
ns
RXCLK period
t
CC
-
400
-
-
40
-
ns
TXCLK
tDV
tEV
tEV
tCLO
tCHI
tCC
TXEN
TXD
tDH
tDS
tDVH
tDVS
tCLO
tCHI
tCC
RXCLK
RXDV
RXD
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