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參數(shù)資料
| 型號： | MC68HC08KH12A |
| 廠商： | 飛思卡爾半導體(中國)有限公司 |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 146/178頁 |
| 文件大小： | 925K |
| 代理商： | MC68HC08KH12A |
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External Interrupt (IRQ)
MC68HC08KH12A Data Sheet, Rev. 1.1
146
Freescale Semiconductor
The vector fetch or software clear may occur before or after the interrupt pin returns to logic one. As long
as the pin is low, the interrupt request remains pending. A reset will clear the latch and the MODE1 control
bit, thereby clearing the interrupt even if the pin stays low.
When set, the IMASK1 bit in the ISCR mask all external interrupt requests. A latched interrupt request is
not presented to the interrupt priority logic unless the IMASK1 bit is clear.
NOTE
The interrupt mask (I) in the condition code register (CCR) masks all
interrupt requests, including external interrupt requests.(See
7.5 Exception
Control
.)
Figure 14-1. IRQ Module Block Diagram
Addr.
Register Name
Bit 7
6
5
4
3
2
1
Bit 0
$001E
IRQ Status/Control Register
(ISCR)
Read:
0
0
0
0
IRQF1
0
IMASK1
MODE1
Write:
ACK1
Reset:
0
0
0
0
0
0
0
0
= Unimplemented
Figure 14-2. IRQ Register Summary
ACK1
RESET
IMASK1
D
Q
CK
CLR
IRQ1
INTERRUPT
REQUEST
HIGH
VOLTAGE
DETECT
TO MODE
SELECT
LOGIC
IRQ1
FF
IRQ1
V
DD
MODE1
SYNCHRO-
NIZER
IRQF1
TO CPU FOR
BIL/BIH
INSTRUCTIONS
VECTOR
FETCH
DECODER
I
V
DD
I
NTERNAL
PULLUP
DEVICE
相關(guān)PDF資料 |
PDF描述 |
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