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參數(shù)資料
| 型號： | MC68HC08KH12A |
| 廠商： | 飛思卡爾半導體(中國)有限公司 |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 144/178頁 |
| 文件大?。?/td> | 925K |
| 代理商： | MC68HC08KH12A |
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Computer Operating Properly (COP)
MC68HC08KH12A Data Sheet, Rev. 1.1
144
Freescale Semiconductor
13.4 COP Control Register (COPCTL)
The COP control register is located at address $FFFF and overlaps the reset vector. Writing any value to
$FFFF clears the COP counter and starts a new timeout period. Reading location $FFFF returns the low
byte of the reset vector.
13.5 Interrupts
The COP does not generate CPU interrupt requests.
13.6 Monitor Mode
The COP is disabled in monitor mode when V
DD
+ V
HI
is present on the IRQ1/V<st-subsmallcaps>pp pin
or on the RST pin.
13.7 Low-Power Modes
The WAIT and STOP instructions put the MCU in low-power consumption standby modes.
13.7.1 Wait Mode
The COP continues to operate during wait mode. To prevent a COP reset during wait mode, periodically
clear the COP counter in a CPU interrupt routine.
13.7.2 Stop Mode
Stop mode turns off the CGMXCLK input to the COP and clears the SIM counter. Service the COP
immediately before entering or after exiting stop mode to ensure a full COP timeout period after entering
or exiting stop mode.
13.8 COP Module During Break Mode
The COP is disabled during a break interrupt when V
DD
+ V
HI
is present on the RST pin.
Address: $FFFF
Bit 7
6
5
4
3
2
1
Bit 0
Read:
Low byte of reset vector
Write:
Clear COP counter
Reset:
Unaffected by reset
Figure 13-4. COP Control Register (COPCTL)
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數(shù) |
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