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參數(shù)資料
| 型號： | LSIFC919 |
| 英文描述： | LSIFC919 Single Channel Fibre Channel I/O Processor technical manual v2.0 10/01 |
| 中文描述： | LSIFC919單通道光纖通道I / O處理器技術(shù)手冊2.0 10/01 |
| 文件頁數(shù)： | 93/144頁 |
| 文件大?。?/td> | 1496K |
| 代理商： | LSIFC919 |
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AC Timings
6-5
6.2 AC Timings
The AC characteristics described in this section apply over the entire
range of operating conditions. Chip timings are based on simulation at
worst case voltage, temperature, and processing. Timings were
developed with a load capacitance of 50 pF.
6.2.1 PCI Interface Timing Diagrams
Figure 6.1
through
Figure 6.10
represent signal activity when the
LSIFC909 accesses the PCI bus. The timings for the PCI bus are listed
in
Table 6.12
on
page 6-17
. The LSIFC909 conforms to Revision 2.2 of
the PCI Local Bus Specification. The timing specifications are provided
Table 6.10
4 mA Bidirectional Signals (MD[31:0], MP[3:0], SDA)
Symbol
Parameter
Min
Max
Unit
Test Conditions
V
IH
Input high voltage
2.0
5.25
V
–
V
IL
Input low voltage
V
SS
0.3
0.8
V
–
V
OH
Output high voltage
2.4
V
DD
V
4 mA
V
OL
Output low voltage
V
SS
0.4
V
4 mA
I
OZ
3-state leakage
10
10
μ
A
–
Table 6.11
8 mA Bidirectional Signals (GPIO[3:0])
Symbol
Parameter
Min
Max
Unit
Test Conditions
V
IH
Input high voltage
2.0
5.25
V
–
V
IL
Input low voltage
V
SS
0.3
0.8
V
–
V
OH
Output high voltage
2.4
V
DD
V
8 mA
V
OL
Output low voltage
V
SS
0.4
V
8 mA
I
OZ
3-state leakage
10
10
μ
A
–
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