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參數(shù)資料
| 型號： | LSIFC919 |
| 英文描述： | LSIFC919 Single Channel Fibre Channel I/O Processor technical manual v2.0 10/01 |
| 中文描述： | LSIFC919單通道光纖通道I / O處理器技術(shù)手冊2.0 10/01 |
| 文件頁數(shù)： | 84/144頁 |
| 文件大?。?/td> | 1496K |
| 代理商： | LSIFC919 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁當前第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁
5-28
Registers
Register: 0x30
Host Interrupt Status
Read Only
The
Host Interrupt Status
register provides read only interrupt status
information to the PCI host. A write of any value to this register will clear
the interrupt associated with the System Doorbell.
IOPDS
IOP Doorbell Status (Read Only)
This bit when set to 1 indicates that the IOP has received
a System->IOP Doorbell message but has not yet
processed it (has not cleared the corresponding SysReq
interrupt).
31
R
Reserved (Read Only)
Reserved for future use.
[30:4]
RI
Reply Interrupt (Read Only)
Reply Interrupt – set to 1 when:
Std reply option – whenever the ReplyPostFIFO is not
empty.
Alt reply option – whenever the
Host Index
register is
not equal to the ReplyPostWrPtr register.
3
If this bit is set to 1 and the corresponding mask bit in the
Host Interrupt Mask
is cleared to 0, a PCI INTA/ interrupt
will be generated.
R
Reserved (Read Only)
Reserved for future use.
[2:1]
DI
Doorbell Interrupt (Read Only)
System Doorbell Interrupt – set to 1 when the IOP writes
a value to the System Doorbell. Cleared by a write of any
value to this register. If this bit is set to 1 and the
0
31
30
16
IOPDS
R
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
15
4
3
2
1
0
R
RI
R
DI
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
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