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參數(shù)資料
| 型號： | LSIFC919 |
| 英文描述： | LSIFC919 Single Channel Fibre Channel I/O Processor technical manual v2.0 10/01 |
| 中文描述： | LSIFC919單通道光纖通道I / O處理器技術(shù)手冊2.0 10/01 |
| 文件頁數(shù)： | 51/144頁 |
| 文件大?。?/td> | 1496K |
| 代理商： | LSIFC919 |
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4-11
TESTRESET/
B13
I
N/A
Test Reset.
Forces chip into Power-On-Reset state or
Soft-Reset state, depending on the state of the Mode pins.
This pad contains an internal 100
μ
A pull-up.
ARMEN/
C14
I
N/A
ARM Enable.
When this pin is asserted LOW, the ARM
RISC processor core (IOP) is enabled and will boot from
Flash ROM following chip reset. If this configuration pin is
held HIGH, the IOP core will be held reset until the
DisARM bit in the Diagnostic register is cleared by the
host CPU. This pad contains an internal 100
μ
A pull-up.
FSELZ
B6
I
N/A
Frequency Select.
This pin when HIGH indicates that the
REFCLK input shall be internally divided by 2 to generate
the internal ZCLK source (106.25 / 2 = 53.125 MHz).
When this pin is LOW, the internal ZCLK tree is sourced
directly from the ZCLK input signal. This pad contains an
internal 100
μ
A pull-up.
MODE[7:0]
D8,
A9,
B9,
C9,
D9,
A10,
B10,
C10
I
N/A
Mode Select.
This 8-bit bus defines operational and test
modes for the chip. For Normal Mode, MODE7 and
MODE6 should be tied LOW. The Mode encodings are
given below:
Normal Mode
Mode[7:0] = 0011xxxx==Interleaved BSRAM
Mode[7:0] = 0001xxxx==Noninterleaved BSRAM
Mode[7:0] = 00x11xxx==GBIC (Fault is active HIGH)
Mode[7:0] = 00x10xxx==MIA (Fault is active LOW)
Mode[7:0] = 00x1x1xx==Soft Reset Mode
Mode[7:0] = 00x1xx11==Normal SEPROM Auto Load
Mode[7:0] = 00x1xx01==Firmware PCI Config Mode
(ARMEN/ must also be LOW)
Mode[7:0] = 00x1xx00 ==PCI Config use default values
All other combinations are reserved.
Each of these pads contains an internal 100
μ
A pull-up.
Table 4.5
Configuration Signals (Cont.)
Name
BGA
Pos
Type
Strength
Description
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