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參數(shù)資料
| 型號： | LSIFC919 |
| 英文描述： | LSIFC919 Single Channel Fibre Channel I/O Processor technical manual v2.0 10/01 |
| 中文描述： | LSIFC919單通道光纖通道I / O處理器技術(shù)手冊2.0 10/01 |
| 文件頁數(shù)： | 54/144頁 |
| 文件大?。?/td> | 1496K |
| 代理商： | LSIFC919 |
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4-14
Signal Descriptions
Table 4.8
describes the Power and Ground signals.
TDI_ICE2
A4
I
N/A
IOP Debug Test Data In.
This pad contains an internal
100
μ
A pull-up to provide a HIGH level on this pin, if it
is not used. If used, an external pull-up is also
required.
TDO_ICE2
B4
O
4mA
IOP Debug Test Data Out.
This pad contains an
internal 100
μ
A pull-up.
TMS_ICE2
C5
I
N/A
IOP Test Mode Select.
This pad contains an internal
100
μ
A pull-up to provide a HIGH level on this pin, if it
is not used. If used, an external pull-up is also
required.
Table 4.7
JTAG Test and IOP Debug Signals (Cont.)
Name
BGA Pos
Type
Strength Description
Table 4.8
Power and Ground Signals
Name
BGA Pos
Description
Voltage
VDD
D7, D10, D14, D17,
G4, G20, K4, K20,
P4, P20, U4, U20,
Y7, Y10, Y14, Y17
I/O power.
3.3 V
VSS
AA3, AA21, AC9, C3,
C21, D4, D12, D20,
K10, K11, K12, K13,
K14, L10, L11, L12,
L13, L14, M4, M10,
M11, M12, M13, M14,
M20, N10, N11, N12,
N13, N14, P10, P11,
P12, P13, P14, Y4,
Y12, Y20
I/O ground.
0 V
VDDA1
L4
Analog power
for integrated transceiver core.
3.3 V
VSSA1
K2
Analog ground
for integrated transceiver core.
0 V
VDDA2
K3
Analog power
for integrated transceiver core.
3.3 V
VSSA2
J1
Analog ground
for integrated transceiver core.
0 V
VDDA3
J4
Analog power
for integrated transceiver core.
3.3 V
VSSA3
H1
Analog ground
for integrated transceiver core.
0 V
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