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參數(shù)資料
| 型號： | LSIFC919 |
| 英文描述： | LSIFC919 Single Channel Fibre Channel I/O Processor technical manual v2.0 10/01 |
| 中文描述： | LSIFC919單通道光纖通道I / O處理器技術(shù)手冊2.0 10/01 |
| 文件頁數(shù)： | 31/144頁 |
| 文件大?。?/td> | 1496K |
| 代理商： | LSIFC919 |
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LSIFC909 Fibre Channel I/O Processor
3-1
Chapter 3
LSIFC909 Overview
This chapter provides a general description of the LSIFC909 FC PCI
Protocol Controller firmware. The chapter contains the following sections:
Section 3.1, “Introduction”
Section 3.2, “Data Flows”
Section 3.3, “Message Interface”
Section 3.4, “SCSI Message Class”
Section 3.5, “LAN Message Class”
Section 3.6, “Target Message Class”
Section 3.7, “Support Components”
3.1 Introduction
The LSI Logic LSIFC909 connects a host to a high speed FC link. The
LSIFC909 sophisticated firmware implementation supports the FCP
ANSI standard and FC Private Loop Direct Attach (and Fabric Loop
Attach) profiles. All profiles, specifications, and interoperability
maintained by the LSIFC909 are listed in
Appendix B, “Reference
Specifications.”
Although optimized for a 64-bit PCI interface to communicate with the
system CPU(s) and memory, the LSIFC909 also supports a 32-bit PCI
environment. The system interface to the LSIFC909 minimizes the
amount of PCI bandwidth required to support I/O requests. A packetized
message passing interface reduces the number of single cycle PCI bus
cycles. All FC Data traffic on the PCI bus occurs with zero wait-state
bursts across the PCI bus.
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PDF描述 |
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