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參數(shù)資料
| 型號(hào)： | LR38666Y |
| 廠商： | Sharp Corporation |
| 元件分類： | 數(shù)字信號(hào)處理 |
| 英文描述： | CMOS digital signal processor |
| 中文描述： | CMOS數(shù)字信號(hào)處理器 |
| 文件頁(yè)數(shù)： | 34/38頁(yè) |
| 文件大?。?/td> | 203K |
| 代理商： | LR38666Y |
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34
LR38666Y
(DV
DD
= 3.3 V, DV
DD2
= 2.5 V, T
A
= 0 to +70C)
PARAMETER
SYMBOL
CONDITIONS
UNIT
NOTE
MIN.
68
0
TYP.
83
MAX.
98
14
Receiving period of 1 bit
T
WPUR
T
DRCV
ns
ns
1
Permissible delay period of received data
NOTE :
1. When "High" or "Low" continues for N bits period, it is (48 MHz)
–1
x 4 x N±3 ns.
UART TIMING
T
WPAR
SDI
1
SDO
1
T
WPAT
Fig. 16 UART Communication Cycle
PARAMETER
SYMBOL
CONDITIONS
UNIT
NOTE
MIN.
8.57
8.57
TYP.
MAX.
SDI
1
input pulse width
SDO
1
output pulse width
T
WPAR
T
WPAT
μs
μs
2
NOTES :
1. Output load capacity C
L
= 15 pF
2. The baud rate is assumed to be 115.2 k bps.
1, 2
(DV
DD
= 3.3 V, DV
DD2
= 2.5 V, T
A
= 0 to +70C)
USB receiving timing
T
WPUR
T
WPUR
T
DRCV
T
WPUR
GIO
13
(as RX_VPI)
GIO
14
(as RX_VMI)
GIO
15
(as RX_DATA)
Fig. 15 USB Receiving Cycle
相關(guān)PDF資料 |
PDF描述 |
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