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參數(shù)資料
| 型號： | LR38666Y |
| 廠商： | Sharp Corporation |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | CMOS digital signal processor |
| 中文描述： | CMOS數(shù)字信號處理器 |
| 文件頁數(shù)： | 20/38頁 |
| 文件大?。?/td> | 203K |
| 代理商： | LR38666Y |
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20
LR38666Y
NOTES :
1. Output load capacity C
L
= 15 pF
2. When the internal bus of the LR38666Y accesses to the flash memory during T
RPH
, it is made to wait.
Flash memory hard reset timing
T
RPL
RESETZ
FLRP0Z/1Z
T
RPH
Fig. 6 Flash Memory Reset Cycle
PARAMETER
SYMBOL
CONDITIONS
UNIT
NOTE
MIN.
MAX.
"Low" pulse period of FLRP0Z/1Z
(relative to the rising edge of RESETZ)
"High" pulse period of FLRP0Z/1Z
(relative to the rising edge of FLR0/1Z)
T
RPL
11T
MCLK
12T
MCLK
ns
1
T
RPH
98T
MCLK
ns
1, 2
(DV
DD
= 3.3 V, DV
DD2
= 2.5 V, T
A
= 0 to +70C)
Flash memory initialization timing
T
RPL
FLRP0Z/1Z
Fig. 7 Flash Memory Initialization Cycle
PARAMETER
SYMBOL
CONDITIONS
UNIT
NOTE
MIN.
12T
MCLK
(DV
DD
= 3.3 V, DV
DD2
= 2.5 V, T
A
= 0 to +70C)
NOTE :
1. Output load capacity C
L
= 15 pF
1
ns
MAX.
12T
MCLK
"Low" pulse period of FLRP0Z/1Z
T
RPL
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PDF描述 |
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