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參數(shù)資料
| 型號： | LR38666Y |
| 廠商： | Sharp Corporation |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | CMOS digital signal processor |
| 中文描述： | CMOS數(shù)字信號處理器 |
| 文件頁數(shù)： | 16/38頁 |
| 文件大?。?/td> | 203K |
| 代理商： | LR38666Y |
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16
LR38666Y
AC Characteristics
SDRAM INTERFACE TIMING
0.8 DV
DD
T
MCLKL
T
MCLKH
0.8 DV
DD
0.2 DV
DD
0.8 DV
DD
0.2 DV
DD
0.2 DV
DD
T
MCSD
T
MCASD
T
MRASD
T
MWED
T
MCKED
T
MDQMD
MEMCLK
MEMCS0Z-MEMCS3Z
MEMRASZ
MEMCASZ
MEMWEZ
MEMCKE
1
-MEMCKE
3
MEML(U)DQM
Common to all waveforms
shown above
MEMD [31 : 0]
MEMA [14 : 0]
Common to all
waveforms shown above
T
MCSD
T
MCASD
T
MRASD
T
MWED
T
MCKED
T
MDQMD
T
MAD
T
MDD
T
MAD
T
MDD
T
MCLK
Fig. 3 SDRAM Output Timing
Fig. 4 SDRAM Input Timing
NOTE :
MEMCLK is also used as the data latch clock inside the LR38666Y. Check the waveform of the incoming MEMCLK
signal for no distortion.
0.8 DV
DD
0.8 DV
DD
0.2 DV
DD
T
MDS
T
MDH
0.2 DV
DD
MEMCLK
(NOTE)
MEMD [31 : 0]
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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