Table 3-13 DR" />
參數(shù)資料
型號(hào)： DSPB56366AG120
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 58/110頁(yè)
文件大?。?/td> 0K
描述： IC DSP 24BIT AUD 120MHZ 144-LQFP
產(chǎn)品變化通告： Product Discontinuation 24/Feb/2012
標(biāo)準(zhǔn)包裝： 60
系列： DSP56K/Symphony
類型： 音頻處理器
接口： 主機(jī)接口，I²C，SAI，SPI
時(shí)鐘速率： 120MHz
非易失內(nèi)存： ROM（240 kB）
芯片上RAM： 69kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 3.30V
工作溫度： -40°C ~ 110°C
安裝類型： 表面貼裝
封裝/外殼： 144-LQFP
供應(yīng)商設(shè)備封裝： 144-LQFP（20x20）
包裝： 托盤
DSP56366 Technical Data, Rev. 3.1
Freescale Semiconductor
3-25
Figure 3-14 DRAM Out-of-Page Wait States Selection Guide
Table 3-13 DRAM Out-of-Page and Refresh Timings, Four Wait States1, 2
No.
Characteristics3
Symbol
Expression
20 MHz4
30 MHz4
Unit
Min
Max
Min
Max
157
Random read or write cycle time
tRC
5
× T
C
250.0
—
166.7
—
ns
158
RAS assertion to data valid (read)
tRAC
2.75
× T
C 7.5
—
130.0
—
84.2
ns
159
CAS assertion to data valid (read)
tCAC
1.25
× T
C 7.5
—
55.0
—
34.2
ns
160
Column address valid to data valid (read)
tAA
1.5
× T
C 7.5
—
67.5
—
42.5
ns
161
CAS deassertion to data not valid (read hold
time)
tOFF
0.0
—
0.0
—
ns
162
RAS deassertion to RAS assertion
tRP
1.75
× T
C 4.0
83.5
—
54.3
—
ns
163
RAS assertion pulse width
tRAS
3.25
× T
C 4.0
158.5
—
104.3
—
ns
164
CAS assertion to RAS deassertion
tRSH
1.75
× T
C 4.0
83.5
—
54.3
—
ns
Chip Frequency
(MHz)
DRAM Type
(tRAC ns)
100
80
70
50
66
80
100
4 Wait States
8 Wait States
11 Wait States
15 Wait States
Notes This figure should be use for primary selection. For exact
and detailed timings see the following tables.
60
40
120
AA0475
相關(guān)PDF資料
PDF描述
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