參數(shù)資料
型號(hào)： DSPB56366AG120
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 13/110頁(yè)
文件大?。?/td> 0K
描述： IC DSP 24BIT AUD 120MHZ 144-LQFP
產(chǎn)品變化通告： Product Discontinuation 24/Feb/2012
標(biāo)準(zhǔn)包裝： 60
系列： DSP56K/Symphony
類型： 音頻處理器
接口： 主機(jī)接口，I²C，SAI，SPI
時(shí)鐘速率： 120MHz
非易失內(nèi)存： ROM（240 kB）
芯片上RAM： 69kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 3.30V
工作溫度： -40°C ~ 110°C
安裝類型： 表面貼裝
封裝/外殼： 144-LQFP
供應(yīng)商設(shè)備封裝： 144-LQFP（20x20）
包裝： 托盤
DSP56366 Technical Data, Rev. 3.1
Freescale Semiconductor
2-7
BG
Input
Ignored Input Bus Grant—BG is an active-low input. BG is asserted by an external bus
arbitration circuit when the DSP56366 becomes the next bus master. When BG
is asserted, the DSP56366 must wait until BB is deasserted before taking bus
mastership. When BG is deasserted, bus mastership is typically given up at the
end of the current bus cycle. This may occur in the middle of an instruction that
requires more than one external bus cycle for execution.
For proper BG operation, the asynchronous bus arbitration enable bit (ABE) in
the OMR register must be set.
BB
Input/Output
Input
Bus Busy—BB is a bidirectional active-low input/output. BB indicates that the
bus is active. Only after BB is deasserted can the pending bus master become
the bus master (and then assert the signal again). The bus master may keep
BB asserted after ceasing bus activity regardless of whether BR is asserted or
deasserted. This is called “bus parking” and allows the current bus master to
reuse the bus without rearbitration until another device requires the bus. The
deassertion of BB is done by an “active pull-up” method (i.e., BB is driven high
and then released and held high by an external pull-up resistor).
For proper BB operation, the asynchronous bus arbitration enable bit (ABE) in
the OMR register must be set.
BB requires an external pull-up resistor.
Table 2-7 External Bus Control Signals (continued)
Signal Name
Type
State during
Reset
Signal Description
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