參數(shù)資料
型號(hào)： DSPB56366AG120
廠商： Freescale Semiconductor
文件頁數(shù)： 36/110頁
文件大小： 0K
描述： IC DSP 24BIT AUD 120MHZ 144-LQFP
產(chǎn)品變化通告： Product Discontinuation 24/Feb/2012
標(biāo)準(zhǔn)包裝： 60
系列： DSP56K/Symphony
類型： 音頻處理器
接口： 主機(jī)接口，I²C，SAI，SPI
時(shí)鐘速率： 120MHz
非易失內(nèi)存： ROM（240 kB）
芯片上RAM： 69kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 3.30V
工作溫度： -40°C ~ 110°C
安裝類型： 表面貼裝
封裝/外殼： 144-LQFP
供應(yīng)商設(shè)備封裝： 144-LQFP（20x20）
包裝： 托盤
DSP56366 Technical Data, Rev. 3.1
Freescale Semiconductor
3-5
3.7
EXTERNAL CLOCK OPERATION
The DSP56366 system clock is an externally supplied square wave voltage source connected to EXTAL
Figure 3-1 External Clock Timing
Internal clock cycle time with PLL
disabled
TC
—2
× ET
C
—
Instruction cycle time
ICYC
—TC
—
1 DF = Division Factor
Ef = External frequency
ETC = External clock cycle
MF = Multiplication Factor
PDF = Predivision Factor
TC = internal clock cycle
2 See the PLL and Clock Generation section in the DSP56300 Family Manual for a detailed discussion of the PLL.
Table 3-5 Clock Operation
No.
Characteristics
Symbol
Min
Max
1
Frequency of EXTAL (EXTAL Pin Frequency)
The rise and fall time of this external clock should be 3 ns maximum.
Ef
0
120.0
2
EXTAL input high1, 2
With PLL disabled (46.7%–53.3% duty cycle3)
With PLL enabled (42.5%–57.5% duty cycle3)
ETH
3.89 ns
3.54 ns
∞
157.0
μs
3
EXTAL input low1, 2
With PLL disabled (46.7%–53.3% duty cycle3)
With PLL enabled (42.5%–57.5% duty cycle3)
ETL
3.89 ns
3.54 ns
∞
157.0
μs
Table 3-4 Internal Clocks
Characteristics
Symbol
Expression1, 2
Min
Typ
Max
EXTAL
VILC
VIHC
Midpoint
Notes The midpoint is 0.5 (VIHC + VILC).
ETH
ETL
ETC
3
4
2
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