參數(shù)資料
型號： 29KPROG
英文描述： 5-Pin, Multiple-Input, Programmable Reset ICs
中文描述： 處理器初始化和運行時服務：OSBOOT編程29,000 RISC系列
文件頁數(shù)： 414/582頁
文件大?。?/td> 2132K
代理商： 29KPROG
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October 13 1995, Draft 1
390
Addendum to –– Evaluating and Programming the 29K RISC Family
A processed trace line contains the instruction which was in write–back during
the captured trace cycle, or data which was transferred during the cycle. Put another
way, if an instruction is fetched from memory, then during its write–back cycle (if it
reaches execute) the op–code is reported in the processed trace. Let’s look at the algo-
rithm used with the Am29040 Traceable Cache preprocessor. The DATA and ADDR
labels have their values changed by the algorithm to reflect the instruction which was
executed during the traced cycle. The DATA and ADDR labels in the raw trace indi-
cate the instruction which was fetched during the traced cycle or data which was ac-
cessed during the cycle. If no data access or instruction execution occurs in a cycle,
then there is no processed trace line corresponding to the raw trace line. MonTIP only
reports lines which are considered
valid
.
The algorithm operates in two stages; first data accesses are processed, then
instruction flow is determined. Data accesses are examined to determine if there are
any repeat accesses reported due to the use of Scalable Clocking. Trace information
is captured at the internal processors speed. The memory system may be running at
half this speed. Consequently, accesses to memory are captured twice in adjacent
trace cycles. Only the final access is considered valid.
Data transfer, due to a load or store instruction, can occur during the same cycle
another instruction is executed. When this happens, the algorithm moves the report-
ing of the data access to a future trace cycle which contains no valid trace informa-
tion. If another data transfer occurs before the previous is reported, then the previous
data value will not be reported. The R/_W, and I/_D information is repositioned
where necessary and possible, so as to report data accesses which occurred. Note,
LOADM and STOREM data transfers are reported before the instruction execution
is reported; this reflects the correct operation of a 29K processor. Currently, the algo-
rithm is being enhanced to enable multiple instruction execution or data accesses to
be reported occurring on different processed trace lines which correspond to the same
captured trace cycle. This eliminates the need to reposition or drop data accesses
reporting. These algorithm enhancements are required by superscalar processors.
Figure 7-15. Path Taken By Am29040 Recursive Trace Processing Algorithm
target
branch
delay–slot
target
branch
delay–slot
target
instruction
sequential
instruction
sequence
相關PDF資料
PDF描述
29W040 4 Mbit 512Kb x8, Uniform Block Low Voltage Single Supply Flash Memory
2A-50C RADIATION HARDENED HIGH EFFICIENCY, 5 AMP SWITCHING REGULATORS
2A01-T 2.0A RECTIFIER
2A02-T 2.0A RECTIFIER
2A03-T 2.0A RECTIFIER
相關代理商/技術參數(shù)
參數(shù)描述
29L06 制造商:CLARKSON 功能描述:CSN HSS SCRW/SHK RNDG CUTTER 3MM
29L10 制造商:CLARKSON 功能描述:CSN HSS SCRW/SHK RNDG CUTTER 5MM
29L102C 功能描述:固定電感器 1.0uH 4.6A Shielded SMD RoHS:否 制造商:AVX 電感:10 uH 容差:20 % 最大直流電流:1 A 最大直流電阻:0.075 Ohms 工作溫度范圍:- 40 C to + 85 C 自諧振頻率:38 MHz Q 最小值:40 尺寸:4.45 mm W x 6.6 mm L x 2.92 mm H 屏蔽:Shielded 端接類型:SMD/SMT 封裝 / 箱體:6.6 mm x 4.45 mm
29L103C 功能描述:固定電感器 10uH 1.55A Shielded SMD RoHS:否 制造商:AVX 電感:10 uH 容差:20 % 最大直流電流:1 A 最大直流電阻:0.075 Ohms 工作溫度范圍:- 40 C to + 85 C 自諧振頻率:38 MHz Q 最小值:40 尺寸:4.45 mm W x 6.6 mm L x 2.92 mm H 屏蔽:Shielded 端接類型:SMD/SMT 封裝 / 箱體:6.6 mm x 4.45 mm
29L104C 功能描述:固定電感器 100uH 480mA Shielded SMD RoHS:否 制造商:AVX 電感:10 uH 容差:20 % 最大直流電流:1 A 最大直流電阻:0.075 Ohms 工作溫度范圍:- 40 C to + 85 C 自諧振頻率:38 MHz Q 最小值:40 尺寸:4.45 mm W x 6.6 mm L x 2.92 mm H 屏蔽:Shielded 端接類型:SMD/SMT 封裝 / 箱體:6.6 mm x 4.45 mm
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