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參數(shù)資料
| 型號： | 28F640W30 |
| 廠商： | Intel Corp. |
| 元件分類： | DRAM |
| 英文描述： | 1.8 Volt Intel Wireless Flash Memory with 3 Volt I/O and SRAM (W30) |
| 中文描述： | 1.8伏英特爾無線閃存的3伏的I / O和SRAM（寬30） |
| 文件頁數(shù)： | 47/82頁 |
| 文件大小： | 749K |
| 代理商： | 28F640W30 |
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28F6408W30, 28F3204W30, 28F320W30, 28F640W30
Preliminary
41
NOTES:
1. See
Figure 12,
“
AC Input/Output Reference Waveform
”
on page 38
for timing measurements and maximum
allowable input slew rate.
2. AC specifications assume the data bus voltage is less than or equal to V
CCQ
when a read operation is
initiated.
3. t
= 85 ns for 128-Mbit device.
4. Address hold in synchronous burst-mode is defined as t
CHAX
or t
VHAX
, whichever timing specification is
satisfied first.
5. OE# may be delayed by up to t
ELQV
–
t
GLQV
after the falling edge of CE# without impact to t
ELQV
.
6. Sampled, not 100% tested.
7. Applies only to subsequent synchronous reads.
Figure 14. Single Word Asynchronous Read Waveform
V
IH
V
IL
Valid
Address
V
IH
V
IL
V
IH
V
IL
V
IH
V
IL
High Z
V
OH
V
OL
Valid
Output
V
IH
V
IL
R1
R2
R3
R4
R5
R7
R10
Generic_Async_Rd
Address [A]
CE# [E]
OE# [G]
WE# [W]
Data [D/Q]
RST# [P]
R8
R9
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| 28F651 | 制造商:Cinch Connectors 功能描述:2 Lug Terminal Strip |
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| 28F653 | 制造商:Cinch Connectors 功能描述:4 Lug Terminal Strip |
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