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參數(shù)資料
| 型號： | 16F876A |
| 廠商： | Microchip Technology Inc. |
| 英文描述： | 28/40-pin Enhanced FLASH Microcontrollers |
| 中文描述： | 28/40-pin增強(qiáng)閃存微控制器 |
| 文件頁數(shù)： | 155/222頁 |
| 文件大小： | 4013K |
| 代理商： | 16F876A |
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2001 Microchip Technology Inc.
Advance Information
DS39582A-page 153
PIC16F87XA
14.13 Watchdog Timer (WDT)
The Watchdog Timer is a free running on-chip RC oscil-
lator, which does not require any external components.
This RC oscillator is separate from the RC oscillator of
the OSC1/CLKIN pin. That means that the WDT will
run, even if the clock on the OSC1/CLKIN and OSC2/
CLKOUT pins of the device has been stopped, for
example, by execution of a
SLEEP
instruction.
During normal operation, a WDT time-out generates a
device RESET (Watchdog Timer Reset). If the device is
in SLEEP mode, a WDT time-out causes the device to
wake-up and continue with normal operation (Watch-
dog Timer Wake-up). The TO bit in the STATUS regis-
ter will be cleared upon a Watchdog Timer time-out.
The WDT can be permanently disabled by clearing
configuration bit WDTE (Section 14.1).
WDT time-out period values may be found in the Elec-
trical Specifications section under parameter #31. Val-
ues for the WDT prescaler (actually a postscaler, but
shared with the Timer0 prescaler) may be assigned
using the OPTION_REG register.
FIGURE 14-11:
WATCHDOG TIMER BLOCK DIAGRAM
TABLE 14-7:
SUMMARY OF WATCHDOG TIMER REGISTERS
Note 1:
The
CLRWDT
and
SLEEP
instructions
clear the WDT and the postscaler, if
assigned to the WDT, and prevent it from
timing out and generating a device
RESET condition.
2:
When a
CLRWDT
instruction is executed
and the prescaler is assigned to the WDT,
the prescaler count will be cleared, but
the prescaler assignment is not changed.
From TMR0 Clock Source
(Figure 5-1)
To TMR0 (
Figure 5-1
)
Postscaler
WDT Timer
WDT
Enable Bit
0
1
M
U
X
PSA
8 - to - 1 MUX
PS2:PS0
0
1
MUX
PSA
WDT
Time-out
8
Note:
PSA and PS2:PS0 are bits in the OPTION_REG register.
Address
Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
2007h
81h,181h
Legend: Shaded cells are not used by the Watchdog Timer.
Note 1:
See Register 14-1 for operation of these bits.
Config. bits
OPTION_REG
(1)
BODEN
(1)
INTEDG
CP1
T0CS
CP0
T0SE
PWRTE
(1)
PSA
WDTE
PS2
FOSC1
PS1
FOSC0
PS0
RBPU
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| 16FL100S05 | 6A, 12A AND 16A FAST RECOVERY RECTIFIERS |
| 16FL100S10 | 6A, 12A AND 16A FAST RECOVERY RECTIFIERS |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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