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參數(shù)資料
| 型號： | (Z)PSD813F1 |
| 英文描述： | Flash In System Programmable Mirocomputer Peripherals(閃速，在系統(tǒng)可編程微控制器外圍器件，1M位閃速存儲器，256K位EEPROM，16K位SRAM) |
| 中文描述： | Flash在系統(tǒng)可編程Mirocomputer外設(shè)（閃速，在系統(tǒng)可編程微控制器外圍器件，100萬位閃速存儲器，256K位的EEPROM，16K的位的SRAM） |
| 文件頁數(shù)： | 7/130頁 |
| 文件大小： | 650K |
| 代理商： | (Z)PSD813F1 |
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Prelimnary
PSD813F Famly
3
J
Optional 64 byte One Time Programmable (OTP) memory that can be used for product
configuration and calibration.
J
CPLD with 16 Output Micro
Cells (OMCs) and 24 Input Micro
Cells (IMCs). The
CPLD may be used to efficiently implement a variety of logic functions for internal
and external control. Examples include state machines, loadable shift registers, and
loadable counters.
J
Decode PLD (DPLD) that decodes address for selection of internal memory blocks.
The DPLD can also be used to generate external chip selects.
J
27 individually configurable I/O port pins that can be used for the following functions:
MCU I/Os
PLD I/Os
Latched MCU address output
Special function I/Os.
16 of the I/O ports may be configured as open-drain outputs.
J
Standby current as low as 50 μA for 5 V devices, 25 μA for 3 V devices.
J
Built-in JTAG compliant serial port allows full-chip In-System Programmability (ISP).
With it, you can program a blank device or reprogram a device in the factory or the field.
J
Internal page register that can be used to expand the microcontroller address space by
a factor of 256.
J
Internal programmable Power Management Unit (PMU) that supports a low power mode
called Power Down Mode. The PMU can automatically detect a lack of microcontroller
activity and put the PSD813F into Power Down Mode.
J
Erase/Write cycles:
Flash memory – 100,000 minimum
EEPROM – 10,000 minimum
PLD – 1,000 minimum
2.0
Key Features
(cont.)
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