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參數(shù)資料
| 型號(hào)： | XRT86VL3X |
| 廠商： | Exar Corporation |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁(yè)數(shù)： | 144/149頁(yè) |
| 文件大小： | 1274K |
| 代理商： | XRT86VL3X |
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XRT86VL3X
137
T1/E1/J1 FRAMER/LIU COMBO - ARCHITECTURE DESCRIPTION
REV. 1.2.0
P
OWER
PC 403 S
YCHRONOUS
I
NTERFACE
T
IMING
The signals used in the Power PC 403 Synchronus microprocessor interface mode are: Address Strobe (AS),
Microprocessor Clock (uPCLK), Data Strobe (DS), Read/Write Enable (R/W), Chip Select (CS), Address and
Data bits. The interface timing is shown in
Figure 119
. The I/O specifications are shown in
Table 28
.
F
IGURE
119. P
OWER
PC 403 I
NTERFACE
S
IGNALS
D
URING
P
ROGRAMMED
I/O R
EAD
AND
W
RITE
O
PERATIONS
T
ABLE
28: P
OWER
PC 403 M
ICROPROCESSOR
I
NTERFACE
T
IMING
S
PECIFICATIONS
S
YMBOL
P
ARAMETER
M
IN
M
AX
U
NITS
t
0
Valid Address to CS Falling Edge
0
-
ns
t
1
CS Falling Edge to WE Assert
0
-
ns
t
2
WE Assert to TA Assert
-
240
ns
NA
WE Pulse Width (t
2
)
240
-
ns
t
3
CS Falling Edge to TS Falling Edge
0
-
t
dc
μ
PCLK Duty Cycle
40
60
%
t
cp
μ
PCLK Clock Period
20
-
ns
CS
ADDR[14:0]
DATA[7:0]
WE
R/W
TA
Valid Data for Readback
Data Available to Write Into the LIU
READ OPERATION
WRITE OPERATION
t
0
t
0
t
2
Valid Address
Valid Address
t
3
t
3
t
1
t
2
TS
uPCLK
t
cp
t
dc
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