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參數(shù)資料
| 型號： | XRT86VL3x |
| 廠商： | Exar Corporation |
| 元件分類： | 通信及網(wǎng)絡 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數(shù)： | 85/153頁 |
| 文件大?。?/td> | 1316K |
| 代理商： | XRT86VL3X |
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XRT86VL3X
78
REV. 1.2.2
T1/E1/J1 FRAMER/LIU COMBO - ARCHITECTURE DESCRIPTION
The Transmit Single-frame Synchronization signal of Channel 0 pulses HIGH for one clock cycle at the first bit
position (F-bit of channel 0) of the multiplexed data stream with data from Channel 0-3 multiplexed together.
The Transmit Single-frame Synchronization signal of Channel 4 pulses HIGH for one clock cycle at the first bit
position (F-bit of Channel 4) of the data stream with data from Channel 4-7 multiplexed together. By sampling
the HIGH pulse on the Transmit Single-frame Synchronization signal, the framer can position the beginning of
the multiplexed DS1 frame. It is responsibility of the Terminal Equipment to align the multiplexed transmit serial
data with the Transmit Single-frame Synchronization pulse.
Inside the framer, all the "don't care" bits will be stripped away. The framing bits, signaling and payload data are
de-multiplexed inside the XRT86VL3x and sent to each individual channel. These data will be processed by
each individual framer and send to the LIU interface. The local Terminal Equipment provides a free-running
1.544MHz clock to the Transmit Serial Input clock of each channel. The framer will use this clock to carry the
processed payload and signaling data to the transmit section of the device.
Figure 85
shows how to connect
the Transmit multiplexed high-speed Input Interface block to local Terminal Equipment.
Figure 89
shows the
timing signal when the transmit framer is running at 12.352 Bit-Multiplexed Mode
F
IGURE
85. I
NTERFACING
XRT86VL3
X
T
RANSMIT
TO
LOCAL
TERMINAL
EQUIPMENT
USING
16.384M
BIT
/
S
, HMVIP
16.384M
BIT
/
S
,
AND
H.100 16.384M
BIT
/
S
TxSER0
TxINCLK0 (12/16MHz)
TxSYNC0
TxSERCLK0 (1.544MHz)
Transmit
Payload
Data Input
Interface
Chn 0
Transmit
Payload
Data Input
Interface
Chn 4
Terminal
Equipment
XRT86VL38
Chn 1
Chn 2
Chn 3
Chn 5
Chn 6
Chn 7
TxSERCLK1 (1.544MHz)
TxSERCLK2 (1.544MHz)
TxSERCLK3 (1.544MHz)
TxSER4
TxINCLK4 (12/16MHz)
TxSYNC4
TxSERCLK4 (1.544MHz)
TxSERCLK5 (1.544MHz)
TxSERCLK6 (1.544MHz)
TxSERCLK7 (1.544MHz)
相關PDF資料 |
PDF描述 |
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