參數(shù)資料
型號(hào)： XC3S1000-4VQG100C
廠商： XILINX INC
元件分類(lèi)： FPGA
英文描述： Spartan-3 FPGA Family: Complete Data Sheet
中文描述： FPGA, 192 CLBS, 50000 GATES, PQFP100
封裝： LEAD FREE, VQFP-100
文件頁(yè)數(shù)： 191/198頁(yè)
文件大小： 1605K
代理商： XC3S1000-4VQG100C
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Spartan-3 FPGA Family: Pinout Descriptions
DS099-4 (v1.6) January 17, 2005
Product Specification
www.xilinx.com
105
R
User I/Os by Bank
Table 41
indicates how the available user-I/O pins are dis-
tributed between the eight I/O banks for the XC3S4000 in
the FG1156 package. Similarly,
Table 42
shows how the
available user-I/O pins are distributed between the eight I/O
banks for the XC3S5000 in the FG1156 package.
VCCAUX CCLK
CCLK
AL31
CONFIG
VCCAUX DONE
DONE
AD24
CONFIG
VCCAUX HSWAP_EN
HSWAP_EN
L11
CONFIG
VCCAUX M0
M0
AL4
CONFIG
VCCAUX M1
M1
AK4
CONFIG
VCCAUX M2
M2
AG8
CONFIG
VCCAUX PROG_B
PROG_B
D4
CONFIG
VCCAUX TCK
TCK
D31
JTAG
Table 40:
FG1156 Package Pinout
(Continued)
Bank
XC3S4000
Pin Name
XC3S5000
Pin Name
FG1156
Pin
Number
Type
VCCAUX TDI
TDI
E4
JTAG
VCCAUX TDO
TDO
E31
JTAG
VCCAUX TMS
TMS
H27
JTAG
Table 40:
FG1156 Package Pinout
(Continued)
Bank
XC3S4000
Pin Name
XC3S5000
Pin Name
FG1156
Pin
Number
Type
Table 41:
User I/Os Per Bank for XC3S4000 in FG1156 Package
Package Edge
I/O
Bank
Maximum
I/O
All Possible I/O Pins by Type
I/O
DUAL
DCI
VREF
GCLK
Top
0
90
79
0
2
7
2
1
90
79
0
2
7
2
Right
2
88
80
0
2
6
0
3
88
79
0
2
7
0
Bottom
4
90
73
6
2
7
2
5
90
73
6
2
7
2
Left
6
88
79
0
2
7
0
7
88
79
0
2
7
0
Table 42:
User I/Os Per Bank for XC3S5000 in FG1156 Package
Package Edge
I/O
Bank
Maximum
I/O
All Possible I/O Pins by Type
I/O
DUAL
DCI
VREF
GCLK
Top
0
100
89
0
2
7
2
1
100
89
0
2
7
2
Right
2
96
87
0
2
7
0
3
96
87
0
2
7
0
Bottom
4
100
83
6
2
7
2
5
100
83
6
2
7
2
Left
6
96
87
0
2
7
0
7
96
87
0
2
7
0
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PDF描述
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