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參數(shù)資料
| 型號(hào)： | XC3S1000-4VQG100C |
| 廠商： | XILINX INC |
| 元件分類： | FPGA |
| 英文描述： | Spartan-3 FPGA Family: Complete Data Sheet |
| 中文描述： | FPGA, 192 CLBS, 50000 GATES, PQFP100 |
| 封裝： | LEAD FREE, VQFP-100 |
| 文件頁(yè)數(shù)： | 14/198頁(yè) |
| 文件大?。?/td> | 1605K |
| 代理商： | XC3S1000-4VQG100C |
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Spartan-3 FPGA Family: Functional Description
DS099-2 (v1.3) August 24, 2004
Preliminary Product Specification
www.xilinx.com
7
R
Table 7:
DCI Terminations
Termination
Schematic
(1)
I/O Standards
Controlled impedance output driver
LVDCI_15
LVDCI_18
LVDCI_25
LVDCI_33
Controlled output driver with half impedance
LVDCI_DV2_15
LVDCI_DV2_18
LVDCI_DV2_25
LVDCI_DV2_33
Single resistor
GTL_DCI
GTLP_DCI
HSTL_III_DCI
(2)
HSTL_III_DCI_18
(2)
Split resistors
HSTL_I_DCI
(2)
HSTL_I_DCI_18
(2)
HSTL_II_DCI_18
LVDS_25_DCI
LVDSEXT_25_DCI
Split resistors with output driver impedance
fixed to 25
SSTL18_I_DCI
(3)
SSTL2_I_DCI
(3)
SSTL2_II_DCI
Notes:
1.
The value of R is equivalent to the characteristic impedance of the line connected to the I/O. It is also equal to half the value of R
REF
for the DV2 standards and R
REF
for all other DCI standards.
For DCI using HSTL Classes I and III, terminations only go into effect at inputs (not at outputs).
For DCI using SSTL Class I, the split termination only goes into effect at inputs (not at outputs).
2.
3.
Z
0
IOB
R
Z
0
IOB
R/2
R
Z
0
V
CCO
IOB
2R
2R
Z
0
V
CCO
IOB
25
2R
2R
Z
0
V
CCO
IOB
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