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參數(shù)資料
| 型號(hào)： | W83627SF |
| 英文描述： | W83627F plus Smart Card Reader Interface. VID Control. GP I/O? |
| 中文描述： | W83627F加上智能卡閱讀器接口。 VID控制。大獎(jiǎng)賽的I / O？ |
| 文件頁數(shù)： | 114/147頁 |
| 文件大小： | 1348K |
| 代理商： | W83627SF |
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W83627SF
PRELIMINARY
Publication Release Date: Nov. 2000
- 107 - Revision 0.60
CR28 (Default 0x00)
Bit 7 - 3
: Reserved.
Bit 2 - 0
: PRTMODS2 - PRTMODS0
= 0xx Parallel Port Mode
= 100 Reserved
= 101 External FDC Mode
= 110 Reserved
= 111 External two FDC Mode
CR29 (GPIO3 multiplexed pin selection register. VBAT powered. Default 0x00)
Bit 7
: PIN64S
= 0 SUSLED (SUSLED control bits are in CRF3 of Logical Device 9)
= 1 GP35
Bit 6
: PIN69S
= 00 CIRRX#
= 01 GP34
Bit 5
: PIN70S
= 0 RSMRST#
= 1 GP33
Bit 4
: PIN71S
= 0 PWROK
= 1 GP32
Bit 3
: PIN72S
= 0 PWRCTL#
= 1 GP31
Bit 2
: PIN 73S
= 0 SLP_SX#
= 1 GP30
Bit 1
: Reserved.
Bit 0
: PIN103S
= 0 Pin 103 and pin 104 function as GP41 and GP40 respectively.
=1 Pin 103 is S5# signal input signal and pin 104 is system S3 state power control
signal.
The corresponding power on setting pin is GP42 (pin 102). Its value is latched on the rising edge of
internal RSMRST# signal (delay of rising edge of Internal RSMRST# signal from VSB on is half way
of that of external RSMRST# pin).
The S3 state power control pin (pin 104) outputs low when VSB is on. It outputs high following the
falling edge of SLP_SX# (pin 73) signal falling edge. Then it is reset by the falling edge of S5# signal
(pin 103).
*Note: The falling edge of PWRCTL# signal (pin 72) is delayed an additional 5ms from the falling
edge of SLP_SX# signal for supporting STR (Suspend To RAM) function.
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參數(shù)描述 |
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| W83627SG-AW | 功能描述:IC LPC SUPER I/O 128-PQFP RoHS:是 類別:集成電路 (IC) >> 接口 - 專用 系列:* 標(biāo)準(zhǔn)包裝:3,000 系列:- 應(yīng)用:PDA，便攜式音頻/視頻，智能電話 接口:I²C，2 線串口 電源電壓:1.65 V ~ 3.6 V 封裝/外殼:24-WQFN 裸露焊盤 供應(yīng)商設(shè)備封裝:24-QFN 裸露焊盤（4x4） 包裝:帶卷 (TR) 安裝類型:表面貼裝 產(chǎn)品目錄頁面:1015 (CN2011-ZH PDF) 其它名稱:296-25223-2 |
| W83627THF | 制造商:Nuvoton Technology Corp 功能描述:I/O Controller LPC Controller 128-Pin PQFP |
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