- 您現(xiàn)在的位置：買(mǎi)賣(mài)IC網(wǎng) > PDF目錄361795 > W83627SF W83627F plus Smart Card Reader Interface. VID Control. GP I/O? PDF資料下載
參數(shù)資料
| 型號(hào)： | W83627SF |
| 英文描述： | W83627F plus Smart Card Reader Interface. VID Control. GP I/O? |
| 中文描述： | W83627F加上智能卡閱讀器接口。 VID控制。大獎(jiǎng)賽的I / O？ |
| 文件頁(yè)數(shù)： | 103/147頁(yè) |
| 文件大?。?/td> | 1348K |
| 代理商： | W83627SF |
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W83627SF
PRELIMINARY
Publication Release Date: Nov. 2000
Revision 0.60
- 96 -
11.5 Smart Card FIFO Control Register (SCFR, write only at "base address + 2")
This register is used to control the FIFO functions of Smart Card interface.
FIFO enable
Receiver FIFO reset
Transmitter FIFO reset
RX interrupt active level (LSB)
RX interrupt active level (MSB)
7
6
5
4
3
2
1
0
Bit 6, 7: These two bits are used to set the active level for the receiver FIFO interrupt. For example, if
the interrupt active level is set as 4 bytes, once there are more than 4 data characters in the
receiver FIFO, the interrupt will be activated to notify the CPU to read the data from the FIFO.
FIFO TRIGGER LEVEL
BIT 7
BIT 6
RX FIFO INTERRUPT ACTIVE LEVEL (BYTES)
0
0
01
0
1
04
1
0
08
1
1
14
Bit 5 - 3: Reserved.
Bit 2: Setting this bit to a logical 1 resets the TX FIFO counter logic to initial state. This bit will be
cleared to a logical 0 by itself after being set to a logical 1.
Bit 1: Setting this bit to a logical 1 resets the RX FIFO counter logic to initial state. This bit will be
cleared to a logical 0 by itself after being set to a logical 1.
Bit 0: This bit enables FIFO of Smart Card interface. This bit should be set to a logical 1 before other
bits of SCFR are programmed.
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PDF描述 |
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參數(shù)描述 |
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| W83627THF | 制造商:Nuvoton Technology Corp 功能描述:I/O Controller LPC Controller 128-Pin PQFP |
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