參數(shù)資料
型號: TSB42AB4I
廠商: Texas Instruments, Inc.
英文描述: IEEE 1394 A CONSUMER ELECTRONICS LINK LAYER CONTROLLER
中文描述: 1394消費電子產(chǎn)品鏈路層控制器
文件頁數(shù): 65/183頁
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代理商: TSB42AB4I
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From the time cell A begins until cell B begins is the amount of time required by the system to
transport cell A. This value is the offset packet time (OFPT) for an inserted packet. If a gap greater
or equal to the OFPT value exists in the transport stream, then ceLynx inserts the packet.
The OFPT value is a 16-bit value that has the same format as the lower 16 bits of the 1394 link
layer CYCLE_TIME register. The upper 4 bits represent the number of whole 125
μ
s 1394 cycles
it takes to transport one MPEG2 cell, and the lower 12 bits represent the number of 25 ns clock
cycles in the additional fraction of a cycle.
For instance, if the time from the beginning of cell A at the HSDI to the beginning of cell B at the
HSDI is 140
μ
s, the OFPT value would be:
Upper 4 bits = (1 x 125
μ
s) = 0x1
Lower 12 bits = (15000 ns/40 ns) = 600 clock cycles = 0x258
OFPT = 0x1258
Step 5:
Write the inserted packet to the insertion buffer. The external host can access the insertion
buffer through the INSBUFx_ACC register. The host should write all quadlets to this
register. If the application does not have enough data to fill the insertion buffer, it can use
the INSBUFx_CSR0.AUTOFILL bit to fill the rest of the insertion buffer locations with FFh.
Step 6:
Enable the insertion buffer. This control bit is located in INSBUFx_CSR0.PKTINSRT_EN.
Once the bit is set to 1, ceLynx inserts the packet into the next available gap, as specified
by OFPT. The INSBUFx_CSR0.PKTINSRT_EN bit is cleared by hardware after the packet
is inserted.
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PDF描述
TSB42AB4PGE IEEE 1394 A CONSUMER ELECTRONICS LINK LAYER CONTROLLER
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