參數(shù)資料
型號(hào): TSB42AA4PGE
廠商: Texas Instruments, Inc.
英文描述: IEEE 1394 A CONSUMER ELECTRONICS LINK LAYER CONTROLLER
中文描述: 1394消費(fèi)電子產(chǎn)品鏈路層控制器
文件頁數(shù): 120/183頁
文件大?。?/td> 798K
代理商: TSB42AA4PGE
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623
0x080 HSDIA_CFG0 – HSDIA Configuration 0 (Continued)
BIT
NAME
TYPE
RESET
FUNCTION
11
RELEASE_DATA
RW
0
Release data mode When this bit is enabled (set to 1), ceLynx
cannot output DV Data to the HSDI, until the following sequence is
performed:
1. HSDI_AV active
2. DV frame out (a GPIO pin) goes active indicating the frame time
stamp has expired.
3. The application activates the DV-frame-in signal (a GPIO pin).
4. The HSDI_EN signal is activated.
The sequence is reset when the buffer is emptied.
10
BYTEENDIAN
RW
0
Byte endian mode – This bit indicates which byte of each 4-byte data
quadlet is presented first at the HSDI. Irrespective of direction, the
byte-wise data presented at the HSDI composes a quadlet of data
as follows:
D[7:0]
First byte = AB
Second byte = CD
Third byte = EF
Fourth byte = 01
BYTEENDIAN = 0
Resulting quadlet = ABCDEF01
BYTEENDIAN = 1
Resulting quadlet = 01EFCDAB
9
SERBITENDIAN
RW
0
Serial bit endianess – This bit determines the order in which bits are
received when the HSDI is configured for serial mode. This bit has
no effect when the HSDI data port is configured for 8-bit mode. For
example, if the following sequence is presented at the HSDI in serial
mode:
D[0]
First
Last
01010101
SERBITENDIAN = 0
Resulting byte = 0x55
SERBITENDIAN = 1
Resulting byte = 0xAA
8
SERIALMODE
RW
0
HSDIA serial mode When set to 1, the HSDIA is in serial mode,
using HSDIA_D0 as the serial data pin.
7:0
HSDIA_BUFFERS
RW
3
HSDIA buffer mapping – The bits in this register correspond to the
buffer addresses mapped to this interface. For example, a 1 in bit
location 0 indicates that buffer 0 is mapped to this HSDI, a 0 in the
same location indicates that buffer 0 is not mapped to this HSDI. By
default, buffers 0 and 1 are mapped to HSDIA.
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PDF描述
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