參數(shù)資料
型號： TMS320VC5409GGU-100
元件分類： 數(shù)字信號處理
英文描述： 16-Bit Digital Signal Processor
中文描述： 16位數(shù)字信號處理器
文件頁數(shù)： 53/78頁
文件大?。?/td> 1018K
代理商： TMS320VC5409GGU-100
TMS320VC5409
FIXED-POINT DIGITAL SIGNAL PROCESSOR
SPRS082C – APRIL 1999 – REVISED MARCH 2000
53
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
HOLD
and HOLDA timings
switching characteristics over recommended operating conditions for memory control signals
and HOLDA, [H = 0.5 t
c(CO)
] (see Figure 23)
PARAMETER
’5409-80, -100
MIN
UNIT
MAX
tdis(CLKL-A)
tdis(CLKL-RW)
tdis(CLKL-S)
ten(CLKL-A)
ten(CLKL-RW)
ten(CLKL-S)
Disable time, address, PS, DS, IS high impedance from CLKOUT low
5
ns
Disable time, R/W high impedance from CLKOUT low
5
ns
Disable time, MSTRB, IOSTRB high impedance from CLKOUT low
5
ns
Enable time, address, PS, DS, IS from CLKOUT low
2H+5
ns
Enable time, R/W enabled from CLKOUT low
2H+5
ns
Enable time, MSTRB, IOSTRB enabled from CLKOUT low
1
2H+5
ns
tv(HOLDA)
Valid time, HOLDA low after CLKOUT low
0
4
ns
Valid time, HOLDA high after CLKOUT low
0
4
ns
tw(HOLDA)
Pulse duration, HOLDA low duration
2H–1
ns
timing requirements for memory control signals and HOLD, [H = 0.5 t
c(CO)
] (see Figure 23)
’5409-80, -100
MIN
4H+8
UNIT
MAX
tw(HOLD)
tsu(HOLD)
Pulse duration, HOLD low
ns
Setup time, HOLD low/high before CLKOUT low
8
ns
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PDF描述
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參數(shù)描述
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