參數(shù)資料
型號： TMS320VC5409GGU-100
元件分類： 數(shù)字信號處理
英文描述： 16-Bit Digital Signal Processor
中文描述： 16位數(shù)字信號處理器
文件頁數(shù)： 47/78頁
文件大?。?/td> 1018K
代理商： TMS320VC5409GGU-100
TMS320VC5409
FIXED-POINT DIGITAL SIGNAL PROCESSOR
SPRS082C – APRIL 1999 – REVISED MARCH 2000
47
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
memory and parallel I/O interface timing (continued)
switching characteristics over recommended operating conditions for a parallel I/O port read
(IOSTRB = 0)
(see Figure 17)
PARAMETER
’5409-80,-100
MIN
UNIT
MAX
td(CLKL-A)
td(CLKH-ISTRBL)
td(CLKH-ISTRBH)
th(A)IOR
Address and IS timings are included in timings referenced as address.
Delay time, CLKOUT low to address valid
0
3
ns
Delay time, CLKOUT high to IOSTRB low
0
3
ns
Delay time, CLKOUT high to IOSTRB high
0
3
ns
Hold time, address after CLKOUT low
0
3
ns
timing requirements for a parallel I/O port read (IOSTRB = 0)[H = 0.5 t
c(CO)
]
(see Figure 17)
’5409-80,-100
MIN
UNIT
MAX
ta(A)IO
ta(ISTRBL)IO
tsu(D)IOR
th(D)IOR
th(ISTRBH-D)R
Address and IS timings are included in timings referenced as address.
This access timing reflects a zero wait-state timing.
Access time, read data access from address valid
Access time, read data access from IOSTRB low
3H–9
ns
2H–8
ns
Setup time, read data before CLKOUT high
8
ns
Hold time, read data after CLKOUT high
0
ns
Hold time, read data after IOSTRB high
0
ns
IS
R/W
IOSTRB
D[15:0]
A[22:0]
CLKOUT
th(A)IOR
td(CLKH-ISTRBH)
th(D)IOR
tsu(D)IOR
ta(A)IO
td(CLKH-ISTRBL)
td(CLKL-A)
ta(ISTRBL)IO
th(ISTRBH-D)R
NOTE A: A[22:16] apply to DMA accesses to extended I/O, DATA, PROGRAM memory. The CPU has access to
only
extended
PROGRAM memory.
Figure 17. Parallel I/O Port Read (IOSTRB = 0)
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PDF描述
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參數(shù)描述
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