參數(shù)資料
型號： TMS320VC5409GGU-100
元件分類： 數(shù)字信號處理
英文描述： 16-Bit Digital Signal Processor
中文描述： 16位數(shù)字信號處理器
文件頁數(shù)： 36/78頁
文件大?。?/td> 1018K
代理商： TMS320VC5409GGU-100
TMS320VC5409
FIXED-POINT DIGITAL SIGNAL PROCESSOR
SPRS082C – APRIL 1999 – REVISED MARCH 2000
36
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
interrupts (continued)
The bits of the interrupt flag register (IFR) and interrupt mask register (IMR) are arranged as shown in Figure 10.
The function of each bit is described in Table 18.
15–14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
RES
DMAC5
DMAC4
BXINT1
DMAC3
BRINT1
DMAC2
HINT
INT3
BXINT2
DMAC1
BRINT2
DMAC0
BXINT0
BRINT0
TINT
INT2
INT1
INT0
Figure 10. IFR and IMR Registers
Table 18. IFR and IMR Register Bit Fields
BIT
FUNCTION
NUMBER
NAME
15–14
–
Reserved for future expansion
13
DMAC5
DMA channel 5 interrupt flag/mask bit
12
DMAC4
DMA channel 4 interrupt flag/mask bit
11
BXINT1/DMAC3
McBSP1 transmit interrupt flag/mask bit
10
BRINT1/DMAC2
McBSP1 receive interrupt flag/mask bit
9
HINT
Host to ’54x interrupt flag/mask
8
INT3
External interrupt 3 flag/mask
7
BXINT2/DMAC1
McBSP2 transmit interrupt flag/mask bit
6
BRINT2/DMAC0
McBSP2 receive interrupt flag/mask bit
5
BXINT0
McBSP0 transmit interrupt flag/mask bit
4
BRINT0
McBSP0 receive interrupt flag/mask bit
3
TINT
Timer interrupt flag/mask bit
2
INT2
External interrupt 2 flag/mask bit
1
INT1
External interrupt 1 flag/mask bit
0
INT0
External interrupt 0 flag/mask bit
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