參數(shù)資料
型號(hào)： TMS320VC5409GGU-100
元件分類： 數(shù)字信號(hào)處理
英文描述： 16-Bit Digital Signal Processor
中文描述： 16位數(shù)字信號(hào)處理器
文件頁(yè)數(shù)： 41/78頁(yè)
文件大?。?/td> 1018K
代理商： TMS320VC5409GGU-100
TMS320VC5409
FIXED-POINT DIGITAL SIGNAL PROCESSOR
SPRS082C – APRIL 1999 – REVISED MARCH 2000
41
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
divide-by-two/divide-by-four clock option (PLL disabled)
The frequency of the reference clock provided at the X2/CLKIN pin can be divided by a factor of two or four to
generate the internal machine cycle. The selection of the clock mode is described in the clock generator section.
When an external clock source is used, the frequency injected must conform to specifications listed in the timing
requirements table.
switching characteristics over recommended operating conditions [H = 0.5t
c(CO)
]
(see Figure 12,
Figure 13, and the recommended operating conditions table)
PARAMETER
’5409-80,-100
UNIT
MIN
TYP
MAX
tc(CO)
td(CIH-CO)
tf(CO)
tr(CO)
tw(COL)
tw(COH)
This device utilizes a fully static design and therefore can operate with tc(CI) approaching
∞
. The device is characterized at frequencies
approaching 0 Hz.
Cycle time, CLKOUT
40
2tc(CI)
ns
Delay time, X2/CLKIN high to CLKOUT high/low
4
10
17
ns
Fall time, CLKOUT
2
ns
Rise time, CLKOUT
2
ns
Pulse duration, CLKOUT low
H–2
H–1
H
ns
Pulse duration, CLKOUT high
H–2
H–1
H
ns
timing requirements (see Figure 13)
’5409-80,-100
UNIT
MIN
MAX
tc(CI)
tf(CI)
tr(CI)
tw(CIL)
Cycle time, X2/CLKIN
20
ns
Fall time, X2/CLKIN
8
ns
Rise time, X2/CLKIN
8
ns
Pulse duration, X2/CLKIN low
5
ns
tw(CIH)
This device utilizes a fully static design and therefore can operate with tc(CI) approaching
∞
. The device is characterized at frequencies
approaching 0 Hz.
Pulse duration, X2/CLKIN high
5
ns
tr(CO)
tf(CO)
CLKOUT
X2/CLKIN
tw(COL)
td(CIH-CO)
tf(CI)
tr(CI)
tc(CO)
tc(CI)
tw(COH)
tw(CIH)
tw(CIL)
Figure 13. External Divide-by-Two Clock Timing
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PDF描述
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參數(shù)描述
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TMS320VC5409PGE100 制造商:Texas Instruments 功能描述:Digital Signal Processor IC
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