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參數(shù)資料
| 型號： | STLC1511 |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | NorthenLite⑩ G.lite BiCMOS Analog Front-End Circuit |
| 中文描述： | NorthenLite⑩G.lite的BiCMOS模擬前端電路 |
| 文件頁數(shù)： | 26/31頁 |
| 文件大小： | 358K |
| 代理商： | STLC1511 |
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STLC1511
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3.8 TIMING
Table 17. describes the timing relationships between important signals.
3.9 POWER UP RESET
When the voltage on the
RESETN
pin is low the bits in the control register will be reset as per the detailed reg-
ister maps in “Digital Interface And Memory Map” on page 20.
In addition, digital output pins,
DTX
,
FRMCLK
, and
RXSOUT[1:0]
are high impedance. The other digital outputs
are always as defined in Table 1 on page 2.
Table 17. Timing
Symbol
Parameter
Spec
Min
Typ
1
<1>Load on all output pads assumed to be < 25pF.This gives a delay through the TLCHT pad of approximately 5ns.
Spec
Max
Unit
s
t
SENB
ENB falling to DIGCLK rising
1
5
ns
t
HENB
ENB rising to DIGCLK falling
1
5
ns
t
SDRX
Data in valid to DIGCLK falling
2
5
ns
t
HDRX
DIGCLK falling to Data in hold
2
5
ns
t
DDTX
DIGCLK rising to Data out valid
5
10
ns
t
SCK35
TXSIN[1:0] valid to CK35M falling
2
5
ns
t
HCK35
CK35M falling to TXSIN[1:0] hold
2
5
ns
t
DRX
CK35M rising to RXSOUT[1:0] valid
5
10
ns
t
DFC
CK35M rising to FRMCLK valid
5
10
ns
t
DDRCK35
DIGREF rising to CK35M rising
10
12
20
ns
t
RDIGREF
DIGREF rise time (20% to 80%)
1
2
3
ns
t
FDIGREF
DIGREF fall time (80% to 20%)
1
2
3
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| STLC1512 | NorthenLite⑩ G.lite BiCMOS Analog Front-End Circuit |
| STLC1 | LED LAMPS CLUSTER DRIVER |
| STLC2150 | BLUETOOTH RADIO TRANSCEIVER |
| STLC2415 | BLUETOOTH BASEBAND WITH INTEGRATED FLASH |
| STLC2500 | BLUETOOTH⑩ SINGLE CHIP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| STLC1512 | 制造商:STMICROELECTRONICS 制造商全稱:STMicroelectronics 功能描述:NorthenLite⑩ G.lite BiCMOS Analog Front-End Circuit |
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