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參數(shù)資料
| 型號(hào)： | SDA9401 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | Scan Rate Converter using Embedded DRAM Technology Units |
| 中文描述： | 掃描頻率轉(zhuǎn)換器采用嵌入式DRAM技術(shù)股 |
| 文件頁(yè)數(shù)： | 32/69頁(yè) |
| 文件大小： | 1142K |
| 代理商： | SDA9401 |
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SDA 9401
Micronas
32
Preliminary Data Sheet
Timing diagram of output signals
Output write parameter
6.5.2
VOUT generator
The VOUT generator has two operation modes, which can be selected by the parameter VOUTFR.
The VOUT signal is active high (VOUTPOL=0) for two output lines. In the freerunning-mode the
VOUT signal is generated depending on the LPFOP parameter.
In the locked-mode the VOUT signal is synchronized by the incoming V-Sync signal VIN (means the
internal VIN delayed by the parameter OPDEL, see also
Input sync controller (ISC)
on page 9). The
RMODE parameter (raster mode 1: progressive, 0: interlaced) determines the scan rate conversion
Parameter
Subaddress
Description
HOUTFR
1: freerun
0: locked
mode
YBORDER
UBORDER
VBORDER
CAPP
00: k = 0
01: k = 8
10: k = 16
11: k = 24
14h
HOUT generator mode select
17h
18h
18h
10h
Y border value (four MSB of the 8 bit colour)
U border value (four MSB of the 8 bit colour)
V border value (four MSB of the 8 bit colour)
Reducing factor for the Active Pixels Per Line Value
(APPL)
Number of active pixels per line = 16 * APPL - 2*k
X1/CLK2
PPLOP * 2 Tx1/clk2
e.g. 432 * 2 / 27 MHz = 32 μs
y0
y1
x
y2
y3
y4
y5
u0
v0
x
u2
v2
u4
v4
((HOUTDEL + 1) * 4 + PD)* Tx1/clk2
ym-2
um-2
ym-1
vm-′2
x
x
m=APPL*16
HREF
APPLOP * 16 * Tx1/clk2
e.g. 45 * 16 = 720 Tx1/clk2
64 * Tx1/clk2
HOUT
YOUT
UVOUT
o
YB
YB
x
YB
YB
y0
y1
UB
VB
x
UB
VB
u0
v4
((HOUTDEL + 1 + NAPOP) * 4 + PD)* Tx1/clk2
YB
UB
YB
VB
x
x
m=APPL*16
YOUT
UVOUT
ALOP
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