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參數(shù)資料
| 型號： | SDA9401 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | Scan Rate Converter using Embedded DRAM Technology Units |
| 中文描述： | 掃描頻率轉(zhuǎn)換器采用嵌入式DRAM技術(shù)股 |
| 文件頁數(shù)： | 15/69頁 |
| 文件大?。?/td> | 1142K |
| 代理商： | SDA9401 |
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Micronas
15
Preliminary Data Sheet
SDA 9401
The figure below shows the input timing and the functionality of the NAPIPDL and NAPIPPH
parameter in case of CCIR 656 and 4:2:2 parallel data input format for one example. The signals
HINint, YINint and UVint are the internal available sampled input signals.
Input timing
CLK1
u0
y0
v0
y1
u2
y2
v2
y3
xxx
y0
y1
y2
y3
xxx
u0
v0
u2
v2
xxx
YIN
YIN
UVIN
CCIR 656 interface
4:2:2 interface
YINint
u4
y4
y4
u4
HINint
UVINint
y0
u0
v0
y1
u2
y2
v2
y3
u4
u0
v0
u2
v2
y0
y1
y3
y4
u0
v0
u2
v2
YINint
UVINint
(NAPIPDL* 4 + NAPIPPH + 7) * Tclk1
=(0 * 4 + 2 + 7) * Tclk1 = 9 Tclk1 (e.g.)
(NAPIPDL* 4 + NAPIPPH + 7) * Tclk1
=(0 * 4 + 3 + 7) * Tclk1 = 10 Tclk1 (e.g.)
HIN
i
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