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參數(shù)資料
| 型號： | SDA9401 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | Scan Rate Converter using Embedded DRAM Technology Units |
| 中文描述： | 掃描頻率轉(zhuǎn)換器采用嵌入式DRAM技術(shù)股 |
| 文件頁數(shù)： | 13/69頁 |
| 文件大?。?/td> | 1142K |
| 代理商： | SDA9401 |
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Micronas
13
Preliminary Data Sheet
SDA 9401
Input data formats
X
ab
:
X: signal component a: sample number b: bit number
Input sync formats
The amplitude resolution for each input signal component is 8 bit, the maximum clock frequency is
27 MHz. Consequently the SDA 9401 is dedicated for application in high quality digital video
systems.
The figure below shows the generation of the internal H- and V-syncs in case of full CCIR 656
mode. The H656 sync is generated after the EAV. The V656 and F656 signals change
synchronously with the EAV timing reference code.
Data
Pin
CCIR 656
FORMAT = 1X
FORMAT = 01
U
07
Y
07
U
06
Y
06
U
05
Y
05
U
04
Y
04
U
03
Y
03
U
02
Y
02
U
01
Y
01
U
00
Y
00
4:2:2 Parallel
FORMAT = 00
YIN7
YIN6
YIN5
YIN4
YIN3
YIN2
YIN1
YIN0
UVIN7
UVIN6
UVIN5
UVIN4
UVIN3
UVIN2
UVIN1
UVIN0
V
07
V
06
V
05
V
04
V
03
V
02
V
01
V
00
Y
17
Y
16
Y
15
Y
14
Y
13
Y
12
Y
11
Y
10
Y
07
Y
06
Y
05
Y
04
Y
03
Y
02
Y
01
Y
00
U
07
U
06
U
05
U
04
U
03
U
02
U
01
U
00
Y
17
Y
16
Y
15
Y
14
Y
13
Y
12
Y
11
Y
10
V
07
V
06
V
05
V
04
V
03
V
02
V
01
V
00
FORMAT
HIN
VIN
YIN
UVIN
00
01 (CCIR 656 only
data)
10
11 (full CCIR 656)
PAL/NTSC
PAL/NTSC
PAL/NTSC
PAL/NTSC
4:2:2
CCIR 656
4:2:2
x
CCIR 656
x
CCIR 656
x
CCIR 656
CCIR 656
x
x
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