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參數(shù)資料
| 型號： | PM73121 |
| 廠商： | PMC-SIERRA INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | AAL1 Segmentation And Reassembly Processor |
| 中文描述： | ATM SEGMENTATION AND REASSEMBLY DEVICE |
| 文件頁數(shù)： | 59/223頁 |
| 文件大?。?/td> | 2300K |
| 代理商： | PM73121 |
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PM73121AAL1gator II
PMC-Sierra, Inc.
L
PMC-980620
,VVXH
AAL1 SAR Processor
Data Sheet
35235,(7$5<$1'&21),'(17,$/7230&6,(55$,1&$1')25,76&86720(56,17(51$/86(
The TUTOPIA responds to the /TATM_FULL signal. If the signal is not asserted, and the TUTO-
PIA has data to send, it will do so by asserting /TATM_EN. If /TATM_FULL is asserted, then the
data flow will be paused in exactly two clock cycles, until the /TATM_FULL signal allows the
cell to be completed. See the timing diagram in
Figure 25 on page 42
.
In PHY mode, the TUTOPIA block sources RPHY_DATA(7:0), RPHY_SOC, and RPHY_
CLAV, while receiving /RPHY_EN. The SOC indication is generated coincident with the first
byte of each cell that is transmitted on RPHY_DATA. In PHY mode, the RATM_DATA and
RATM_SOC signals are driven only when valid data is being sent; otherwise they are tristated.
/RPHY_ADDR is an input and is used only in MPHY mode.
The cell available (RPHY_CLAV) signal indicates when the device has a complete cell to send.
In SPHY mode, RPHY_CLAV is always driven. If in MPHY mode, the output enable for this sig-
nal is the /RPHY_ADDR input delayed by one cycle. In MPHY mode, /RPHY_ADDR is tied to
one of the address signals so RPHY_CLAV is driven only when polled.
The UTOPIA standard defines a 5-bit address. Since the AAL1gator II has only a single active
low address bit, multiple AAL1gator II devices can be connected in parallel to the same MPHY
interface by connecting each one to a separate address bit. In this manner, five AAL1gator IIs can
be connected to an MPHY interface using the following addresses: “0F
h
”, “17
h
”, “1B
h
”, “1D
h
”,
and “1E
h
” with no additional logic. If other addresses are needed or additional devices are to be
connected to the same interface, additional logic may be required.
If a cell is being read in SPHY mode, or is being read from a channel that is being polled in
MPHY mode, the value of RPHY_CLAV will be 1 until the cell has been read out of the FIFO
and there are no more cells to send. In PHY mode, the TUTOPIA block is dependent on the ATM
device to read the data by asserting the /RPHY_EN input. In SPHY mode, data is placed on
RPHY_DATA any cycle following one in which /RPHY_EN was asserted. In MPHY mode, in
Figure 25.
Transmit UTOPIA Timing (ATM Mode)
53
01
02
03
04
05
06
07
TATM_CLK(i)
/TATM_FULL(i)
/TATM_EN(o)
TATM_SOC(o)
TATM_DATA(o)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM73121-RI | AAL1 Segmentation And Reassembly Processor |
| PM73122 | 32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73122-BI | 32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73123 | 8 LINK CES/DBCES AAL1 SAR |
| PM73123-PI | 8 LINK CES/DBCES AAL1 SAR |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PM73121-RI | 制造商:PMC 制造商全稱:PMC 功能描述:AAL1 Segmentation And Reassembly Processor |
| PM73122 | 制造商:PMC 制造商全稱:PMC 功能描述:32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73122-BI | 制造商:PMC 制造商全稱:PMC 功能描述:32 LINK CES/DBCES AAL1 SAR PROCESSOR |
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