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參數(shù)資料
| 型號： | PM73121 |
| 廠商： | PMC-SIERRA INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | AAL1 Segmentation And Reassembly Processor |
| 中文描述： | ATM SEGMENTATION AND REASSEMBLY DEVICE |
| 文件頁數(shù)： | 116/223頁 |
| 文件大小： | 2300K |
| 代理商： | PM73121 |
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PMC-Sierra, Inc.
PM73121AAL1gator II
L
PMC-980620
,VVXH
AAL1 SAR Processor
Data Sheet
35235,(7$5<$1'&21),'(17,$/7230&6,(55$,1&$1')25,76&86720(56,17(51$/86(
6.3.3
TUTOPIA as the PHY Layer Device in Multi-PHY (MPHY) Mode
The TUTOPIA block functions as a receive UTOPIA block when in MPHY mode. The receive
MPHY UTOPIA timing signals are compatible with the ATM Forum UTOPIA Level 2 MPHY
specification.
Table 18 on page 98
indicates the AAL1gator II receive MPHY UTOPIA signal
names and their corresponding UTOPIA designations. The AAL1gator II will not drive RPHY_
CLAV unless /RPHY_ADDR was low the previous cycle. The value driven is dependent on
whether or not the AAL1gator II has a complete cell to send. RPHY_DATA and RPHY_SOC are
tristate, except for the cycles following ones in which /RPHY_EN is active and the AAL1gator II
was selected. The AAL1gator II is selected only if on the falling edge of /RPHY_EN, /RPHY_
ADDR is low. RPHY_SOC indicates the start of a new cell. RPHY_CLAV goes inactive one
cycle after the last data byte has been output if /RPHY_ADDR is low at the time. Figure 65 shows
the data output timing for the TUTOPIA block in MPHY mode. The timing parameters used in
Figure 65 are defined in the table following the figure. All output timing delays assume a capaci-
tive loading of 50 pF. Refer to
section 3.4 “Transmit UTOPIA Interface Block (TUTOPIA)” on
page 41
for additional information.
Symbol
Parameter
Signal
Min
Max
Unit
RPHY_CLK frequency
33
MHz
Tdc
RPHY_CLK duty cycle
45
55
%
Thd
RPHY_CLK hold time
/RPHY_EN
1
ns
Tq
RPHY_CLK-to-output delay
RPHY_CLAV, RPHY_SOC
2
12
ns
Tsu
RPHY_CLK setup time
/RPHY_EN
5
ns
Tq
RPHY_CLK-to-output delay
RPHY_DATA
2
13
ns
Figure 65.
TUTOPIA MPHY Timing
D1
D2
D3
Tq
Tq
Tq
Tsu
Thd
Tdc
RPHY_CLK(i)
/RPHY_ADDR(i)
RPHY_CLAV(o)
RPHY_SOC(o)
RPHY_DATA(o)
/RPHY_EN(i)
相關PDF資料 |
PDF描述 |
|---|---|
| PM73121-RI | AAL1 Segmentation And Reassembly Processor |
| PM73122 | 32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73122-BI | 32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73123 | 8 LINK CES/DBCES AAL1 SAR |
| PM73123-PI | 8 LINK CES/DBCES AAL1 SAR |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| PM73121-RI | 制造商:PMC 制造商全稱:PMC 功能描述:AAL1 Segmentation And Reassembly Processor |
| PM73122 | 制造商:PMC 制造商全稱:PMC 功能描述:32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73122-BI | 制造商:PMC 制造商全稱:PMC 功能描述:32 LINK CES/DBCES AAL1 SAR PROCESSOR |
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