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參數(shù)資料
| 型號： | PM73121 |
| 廠商： | PMC-SIERRA INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | AAL1 Segmentation And Reassembly Processor |
| 中文描述： | ATM SEGMENTATION AND REASSEMBLY DEVICE |
| 文件頁數(shù)： | 127/223頁 |
| 文件大?。?/td> | 2300K |
| 代理商： | PM73121 |
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PMC-Sierra, Inc.
PM73121AAL1gator II
L
PMC-980620
,VVXH
AAL1 SAR Processor
Data Sheet
35235,(7$5<$1'&21),'(17,$/7230&6,(55$,1&$1')25,76&86720(56,17(51$/86(
NOTE: Taa is dependent on the HOLDOFF signal. If HOLDOFF is not asserted when the
access begins, Taa will be a maximum of six SYS_CLK periods. If the access occurs
immediately after another access, then Taa will be 24 to 30 SYS_CLK periods. Refer
to
section 6.5.3 “Microprocessor Holdoff Timing” on page 116
for a description of
the HOLDOFF activity.
6.5.2.3
Microprocessor Write Command Register Timing
Figure 73 on page 112
shows the write command register timing. Writing to the internal com-
mand register is not honored if higher priority internal functions request the memory, or if the
holdoff from a previous microprocessor transfer has not expired.
/PROC_CS and /PROC_WR are double sampled (1 and 2) at the rising edge of SYS_CLK, and at
(3) ADDR17 is sampled to distinguish between a command register write and a RAM write.
As long as HOLDOFF is not high, /SP_ADD_EN, /SP_DATA_EN, and SP_DATA_DIR are acti-
vated at the next clock cycle (3), allowing the microprocessor address and data to pass through the
address and data buffer to the AAL1gator II. The /SP_ADD_EN and the /SP_DATA_EN signals
Tq
Clock-to-output delay
SP_DATA_CLK,/MEM_OE
(deactivate)
/MEM_CS
MEM_OE (activate)
2
15
ns
Tq
Clock-to-output delay
Clock-to-output delay for activation
of /MEM_OE
Address setup to SYS_CLK
Address enable delay
Address setup to SP_DATA_CLK*
Data enable delay from /PROC_CS
and /PROC_RD
/PROC_CS deassertion to /PROC_
ACK deassertion
Data setup to SP_DATA_CLK*
Data hold from SP_DATA_CLK*
SP_DATA_CLK high to
/SP_ADD_EN high
MEM_ADDR hold time from SP_
DATA_CLK*
Z state setup-to-clock
* These parameters are dependent on external components and assume that the requirements from
Table 26 on page 195
are
met.
** These parameters are typical only.
2
2
18
25
ns
ns
Tqmoe
Tasu17
Taed
Tasu
Tded
ADDR17
/SP_ADD_EN
MEM_ADDR, SP_DATA_CLK
/SP_DATA_EN, /PROC_CS,
/PROC_RD
/PROC_ACK
2
5
26
2**
ns
ns
ns
ns
20
15**
Tcea
2
15
ns
Tdsu
Tdh
Tcaen
MEM_DATA
MEM_DATA, SP_DATA_CLK
SP_DATA_CLK, /SP_ADD_EN
11
3
0
ns
ns
ns
Tah
MEM_ADD, SP_DATA_CLK
1
ns
Tzsu
MEM_ADDR
3**
ns
Symbol
Parameter
Signals
Min
Max
Unit
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM73121-RI | AAL1 Segmentation And Reassembly Processor |
| PM73122 | 32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73122-BI | 32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73123 | 8 LINK CES/DBCES AAL1 SAR |
| PM73123-PI | 8 LINK CES/DBCES AAL1 SAR |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PM73121-RI | 制造商:PMC 制造商全稱:PMC 功能描述:AAL1 Segmentation And Reassembly Processor |
| PM73122 | 制造商:PMC 制造商全稱:PMC 功能描述:32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73122-BI | 制造商:PMC 制造商全稱:PMC 功能描述:32 LINK CES/DBCES AAL1 SAR PROCESSOR |
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