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參數(shù)資料
| 型號(hào)： | PM73121 |
| 廠商： | PMC-SIERRA INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | AAL1 Segmentation And Reassembly Processor |
| 中文描述： | ATM SEGMENTATION AND REASSEMBLY DEVICE |
| 文件頁數(shù)： | 120/223頁 |
| 文件大小： | 2300K |
| 代理商： | PM73121 |
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PMC-Sierra, Inc.
PM73121AAL1gator II
L
PMC-980620
,VVXH
AAL1 SAR Processor
Data Sheet
35235,(7$5<$1'&21),'(17,$/7230&6,(55$,1&$1')25,76&86720(56,17(51$/86(
shows the data input timing for the RUTOPIA block in MPHY mode. The timing parameters used
in Figure 68 are defined in the table following the figure. Refer to
section 3.5 “Receive UTOPIA
Interface Block (RUTOPIA)” starting on page 44
for additional information.
6.5
RAM and Microprocessor Timing
6.5.1
RAM Timing
The RAM interface is designed to work with 12 ns SRAMs, which have a write data setup time of
7 ns or less, when SYS_CLK is 40 MHz (the maximum frequency). This interface is asynchro-
nous and the timing parameters are given in this section. If the interface is used at a lower fre-
quency, equations have been provided to calculate the RAM interface timing parameters. The
timing is very dependent on the pulse width of SYS_CLK. The /MEM_WE signals are derived
from the high pulse width of the SYS_CLK input. The high pulse width affects the pulse width of
/MEM_WE and the setup and hold time of MEM_DATA to the rising edge of /MEM_WE.
Refer to
section 8.6 “Board Requirements for the SRAM Interface” on page 174
for impor-
Figure 68.
RUTOPIA MPHY Timing
Symbol
Parameter
Signal
Min
Max
Unit
TPHY_CLK frequency
33
MHz
Tdc
TPHY_CLK duty cycle
45
55
%
Thd
TPHY_CLK hold time
/TPHY_ADDR, TPHY_DATA,
TPHY_SOC, /TPHY_EN
1
ns
Tq
TPHY_CLK-to-output
delay
TPHY_CLAV
12
ns
Tsu
TPHY_CLK setup time
/TPHY_ADDR, TPHY_DATA, TPHY_
SOC, /TPHY_EN
5
ns
D1
D2
D3
D4
Tq
Tsu
Thd
Tdc
TPHY_CLK(i)
/TPHY_ADDR(i)
TPHY_CLAV(o)
TPHY_DATA(i)
TPHY_SOC(i)
/TPHY_EN(i)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM73121-RI | AAL1 Segmentation And Reassembly Processor |
| PM73122 | 32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73122-BI | 32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73123 | 8 LINK CES/DBCES AAL1 SAR |
| PM73123-PI | 8 LINK CES/DBCES AAL1 SAR |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PM73121-RI | 制造商:PMC 制造商全稱:PMC 功能描述:AAL1 Segmentation And Reassembly Processor |
| PM73122 | 制造商:PMC 制造商全稱:PMC 功能描述:32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73122-BI | 制造商:PMC 制造商全稱:PMC 功能描述:32 LINK CES/DBCES AAL1 SAR PROCESSOR |
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