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參數(shù)資料
| 型號： | PM73121 |
| 廠商： | PMC-SIERRA INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | AAL1 Segmentation And Reassembly Processor |
| 中文描述： | ATM SEGMENTATION AND REASSEMBLY DEVICE |
| 文件頁數(shù)： | 118/223頁 |
| 文件大?。?/td> | 2300K |
| 代理商： | PM73121 |
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PMC-Sierra, Inc.
PM73121AAL1gator II
L
PMC-980620
,VVXH
AAL1 SAR Processor
Data Sheet
35235,(7$5<$1'&21),'(17,$/7230&6,(55$,1&$1')25,76&86720(56,17(51$/86(
Figure 66 illustrates the receive ATM UTOPIA timing.
6.4.2
RUTOPIA as the PHY Layer Device in Single-PHY (SPHY) Mode
The RUTOPIA block functions as a transmit UTOPIA block when in SPHY mode. The transmit
SPHY UTOPIA timing signals are compatible with the UTOPIA Level 1 cell-level hand-shaking
specification (refer to
Appendix B, “References”, on page 203
). Table 20 indicates the transmit
UTOPIA signal names and their corresponding UTOPIA designations. The device will not assert
TPHY_CLAV unless it can receive an entire cell. When ready, the device will accept data for any
cycle that /TPHY_EN is active. If the current cell will fill the internal FIFO, then TPHY_CLAV
will be deactivated the same cycle it is receiving the 49th byte of data. Figure 67 shows the data
input timing for the RUTOPIA block in SPHY mode. The timing parameters used in Figure 67
are defined in the table following the figure. Refer
section 3.5 “Receive UTOPIA Interface Block
(RUTOPIA)” starting on page 44
for additional information.
Figure 66.
Receive UTOPIA ATM Timing
Symbol
Parameter
Signals
Min
Max
Unit
Fc
Clock frequency
RATM_CLK
33
MHz
Tdc
Clock duty cycle
RATM_CLK
45
55
%
Tsu
Clock setup
/RATM_EMPTY, RATM_DATA, RATM_SOC
5
ns
Th
Clock hold
/RATM_EMPTY, RATM_DATA, RATM_SOC
1
ns
Tq
Clock-to-output delay
/RATM_EN
2
12
ns
Table 20.
Transmit Signal Names and Corresponding UTOPIA Designations
Signal Name
UTOPIA Name
/TPHY_ADDR
TxAddr
TPHY_DATA
TxData
TPHY_SOC
TxSOC
TPHY_CLAV
TxClav
/TPHY_EN
TxEnb*
TPHY_CLK
TxClk
Tsu
Th
Fc
Tdc
Tq
1
2
4
6
8
3
5
7
RATM_CLK(i)
/RATM_EMPTY(i)
RATM_DATA(i)
RATM_SOC(i)
/RATM_EN(o)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM73121-RI | AAL1 Segmentation And Reassembly Processor |
| PM73122 | 32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73122-BI | 32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73123 | 8 LINK CES/DBCES AAL1 SAR |
| PM73123-PI | 8 LINK CES/DBCES AAL1 SAR |
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參數(shù)描述 |
|---|---|
| PM73121-RI | 制造商:PMC 制造商全稱:PMC 功能描述:AAL1 Segmentation And Reassembly Processor |
| PM73122 | 制造商:PMC 制造商全稱:PMC 功能描述:32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73122-BI | 制造商:PMC 制造商全稱:PMC 功能描述:32 LINK CES/DBCES AAL1 SAR PROCESSOR |
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