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參數(shù)資料
| 型號： | PI7C7300A |
| 廠商： | Pericom Semiconductor Corp. |
| 英文描述： | 3-PORT PCI-to-PCI BRIDGE |
| 中文描述： | 3端口PCI至PCI橋 |
| 文件頁數(shù)： | 18/109頁 |
| 文件大?。?/td> | 779K |
| 代理商： | PI7C7300A |
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PI7C7300A
3-PORT PCI-TO-PCI BRIDGE
ADVANCE INFORMATION
Page 18 OF 109
09/25/03 Revision 1.09
Name
ENUM#
Pin #
R4
Type
POD
Description
Hot Swap Status Indicator.
The output of ENUM#
indicates to the system that an insertion has occurred of
that an extraction is about to occur.
3.7
JTAG BOUNDARY SCAN SIGNALS
Name
TCK
Pin #
V2
Type
PIU
Description
Test Clock.
Used to clock state information and data
into and out of the PI7C7300A during boundary scan.
Test Mode Select.
Used to control the state of the Test
Access Port controller.
Test Data Output.
When SCAN_EN is HIGH, it is
used (in conjunction with TCK) to shift data out of the
Test Access Port (TAP) in a serial bit stream.
Test Data Input.
When SCAN_EN is HIGH, it is used
(in conjunction with TCK) to shift data and instructions
into the Test Access Port (TAP) in a serial bit stream.
Test Reset.
Active LOW signal to reset the Test
Access Port (TAP) controller into an initialized state.
TMS
W1
PIU
TDO
V3
PTS
TDI
W2
PIU
TRST#
U3
PIU
3.8
POWER AND GROUND
Name
VDD
Pin #
B8, C14, D5, D11,
D15, E2, F18, J3,
L17, N2, P19,
U10, V1, V7, V15,
W20
A3, A5, A8, A10,
A15, A17, A20,
C2, D12, D18, E3,
G2, G17, H17, J2,
J9, J10, J11, J12,
K4, K9, K10, K11,
K12, K19, L9,
L10, L11, L12,
M9, M10, M11,
M12, M18, N1,
P18, R2, T18, U2,
U9, U14, U17,
V17, W11, Y6,
Y13
Y1
U4
Type
Description
3.3V Digital Power
VSS
Digital Ground
AVCC
AGND
Analog 3.3V for PLL
Analog Ground for PLL
3.9
PI7C7300A PBGA PIN LIST
Pin #
A1
A3
A5
A7
A9
A11
A13
A15
Name
S2_CBE[2]
VSS
VSS
S2_CBE[0]
S2_AD[2]
S1_CLKOUT[7]
S1_CLKOUT[5]
VSS
Type
PB
-
-
PB
PB
PTS
PTS
-
Pin #
A2
A4
A6
A8
A10
A12
A14
A16
Name
S2_TRDY#
S2_CBE[1]
S2_AD[10]
VSS
VSS
S1_REQ#[6]
S1_GNT#[4]
S1_REQ#[2]
Type
PSTS
PB
PB
-
-
PIU
PO
PIU
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PDF描述 |
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